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參數(shù)資料
| 型號： | IDT82P2284BB |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 323/363頁 |
| 文件大?。?/td> | 0K |
| 描述： | TXRX T1/J1/E1 4CHAN 208-PBGA |
| 標準包裝： | 10 |
| 類型： | 收發(fā)器 |
| 規(guī)程： | T1，E1，J1 |
| 電源電壓： | 1.8V, 3.3V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-BGA |
| 供應商設備封裝： | 208-PBGA（17x17） |
| 包裝： | 托盤 |
| 其它名稱： | 82P2284BB |
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IDT82P2284
QUAD T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Functional Description
62
February 25, 2008
After the stuffed zero (the zero following five consecutive ’One’s) is
discarded, the data stream between the opening flag and the FCS is
divided into blocks. Each block (except the last block) has 32 bytes. The
block will be pushed into a FIFO with one-byte overhead ahead until any
of the following invalid packet conditions occurs:
A packet with error FCS;
The data between the opening flag and the closing flag is less than
5 bytes (including the FCS, excluding the flags);
The extracted HDLC packet does not consist of an integral number
of octets;
A 7F (Hex) abort sequence is received;
Address is not matched if the address comparison is enabled. (The
address comparison mode is selected by the ADRM[1:0] bits. If
high byte address comparison is required, the high byte address
position (the byte following the opening flag) is compared with the
value in the HA[7:0] bits, or with ‘0xFC’ or ‘0xFE’. Here the ‘C/R’ bit
position is excluded to compare. If low byte address comparison is
required, the high byte address position is compared with the value
in the LA[7:0] bits. Here the ‘C/R’ bit position is included to com-
pare. If both bytes address comparison is required, the high byte
address position is compared with the value in the HA[7:0] bits, or
with ‘0xFC’ or ‘0xFE’. Here the ‘C/R’ bit position is excluded to
compare. And the low byte position (the byte following the high
byte address position) is compared with the value in the LA[7:0]
bits.
If any of the above conditions is detected, the current block will be
discarded, but the one-byte overhead will still be written into the FIFO.
The overhead consists of the M[2:0] bits and the length indication bits as
shown in Figure 15.
Figure 15. Overhead Indication In The FIFO
The FIFO depth is 128 bytes. The FIFO is accessed by the DAT[7:0]
bits. When the overhead is read from the FIFO, it will be indicated by the
PACK bit. When all valid HDLC blocks are pushed into the FIFO or all
the blocks are read from the FIFO, it will be indicated by the EMP bit.
The interrupt sources in this block are summarized in Table 30.
When there are conditions meeting the interrupt sources, the corre-
sponding Interrupt Indication bit will be set to ‘1’ and the Interrupt Indica-
tion bit will be cleared by writing a ‘1’. A ‘1’ in the Interrupt Indication bit
means there is an interrupt. The interrupt will be reported by the INT pin
if its Interrupt Enable bit is ‘1’.
overhead (one byte)
bit 7
bit 0
M2
M1
M0
Length Indication
M[2:0]:
= 000: A valid short HDLC packet is received, i.e., the data stream between the opening flag and the FCS is less than 32 bytes (including 32
bytes).
= 001: The current block is not the last block of the HDLC packet.
= 010: The current block is the last block of a valid long (more than 32 bytes) HDLC packet.
= 011: Reserved.
= 100: An invalid short HDLC packet is received and the current block is discarded.
= 101: The current block is the last block of an invalid long HDLC packet and the block is discarded.
= 110: Reserved.
= 111: Reserved.
The Length Indication is valid when the M2 bit is zero: Length Indication = N - 1 (N is the number of byte).
Otherwise, the Length Indication is zero.
相關PDF資料 |
PDF描述 |
|---|---|
| IDT82P2288BBG | TXRX OCTAL T1/E1/J1 256-PBGA |
| IDT82P2521BHG | IC LIU E1 21+1CH SHORT 640-PBGA |
| IDT82P2816BBG | IC LINE INTERFACE UNIT 416-PBGA |
| IDT82P2821BH | IC LIU T1/J1/E1 21+1CH 640-PBGA |
| IDT82P2828BHG | IC LIU T1/J1/E1 28+1CH 640-PBGA |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| IDT82P2284BB8 | 功能描述:TXRX T1/J1/E1 4CHAN 208-PBGA RoHS:否 類別:集成電路 (IC) >> 接口 - 驅(qū)動器，接收器，收發(fā)器 系列:- 標準包裝:250 系列:- 類型:收發(fā)器 驅(qū)動器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應商設備封裝:16-TSSOP 包裝:帶卷 (TR) |
| IDT82P2284BBG | 功能描述:TXRX T1/J1/E1 4CHAN 208-PBGA RoHS:是 類別:集成電路 (IC) >> 接口 - 驅(qū)動器，接收器，收發(fā)器 系列:- 標準包裝:2,500 系列:- 類型:驅(qū)動器 驅(qū)動器/接收器數(shù):4/0 規(guī)程:RS422 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.154"，3.90mm 寬） 供應商設備封裝:16-SOIC N 包裝:帶卷 (TR) |
| IDT82P2284BBG8 | 功能描述:TXRX T1/J1/E1 4CHAN 208-PBGA RoHS:是 類別:集成電路 (IC) >> 接口 - 驅(qū)動器，接收器，收發(fā)器 系列:- 標準包裝:250 系列:- 類型:收發(fā)器 驅(qū)動器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應商設備封裝:16-TSSOP 包裝:帶卷 (TR) |
| IDT82P2288 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Octal T1/E1/J1 Long Haul Short Haul Transceiver |
| IDT82P2288_08 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Octal T1/E1/J1 Long Haul / Short Haul Transceiver |
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