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參數資料
| 型號： | IDT821054APF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 編解碼器 |
| 英文描述： | QUAD PROGRAMMABLE PCM CODEC WITH MPI INTERFACE |
| 中文描述： | A/MU-LAW, PCM CODEC, PQFP64 |
| 封裝： | TQFP-64 |
| 文件頁數： | 22/42頁 |
| 文件大?。?/td> | 512K |
| 代理商： | IDT821054APF |
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IDT821054A QUAD PROGRAMMABLE PCM CODEC WITH MPI INTERFACE INDUSTRIAL TEMPERATURE
For the global and local registers described below, it should be noted that:
1.
R
/W = 0, Read command.
R
/W = 1, Write command.
2. The reserved bit(s) in the registers must be filled in ‘0’ in write operation and be ignored in read operation.
3.4.2
GLOBAL REGISTERS LIST
GREG1: No Operation, Write (A0H); Version Number, Read (20H)
By applying a read operation (20H) to this register, users can read out the version number of the IDT821054A. The default value is 01H.
To write to this register (no operation), a data byte of FFH must follow the write command (A0H) to ensure proper operation.
GREG2: Interrupt Clear, Write Only (A1H)
All interrupts on SLIC I/O will be cleared by applying a write operation to this register. Note that a data byte of FFH must follow the write
command (A1H) to ensure proper operation.
GREG3: Software Reset, Write Only (A2H)
A write operation to this register resets all local registers, but does not reset global registers and the Coe-RAM. Note that when writing to
this register, a data byte of FFH must follow the write command (A2H) to ensure proper operation.
GREG4: Hardware Reset, Write Only (A3)
A write operation to this register is equivalent to setting the
RESET
pin to logic low (Refer to
“3.3 Default State After Reset” on page 19
for details). Note that when applying this write command, a data byte of FFH must follow to ensure proper operation.
GREG5: Chopper Clock Selection, Read/Write (24H/A4H)
This register is used to select the frequency of the CHclk2 and CHclk1 output signals.
CHclk2[1:0] = 00:
the output of chclk2 is set to high permanently (default);
CHclk2[1:0] = 01:
chclk2 outputs a digital signal with the frequency of 512 kHz;
CHclk2[1:0] = 10:
chclk2 outputs a digital signal with the frequency of 256 kHz;
CHclk2[1:0] = 11:
chclk2 outputs a digital signal with the frequency of 16384 kHz;
CHclk1[3:0] = 0000:
CHclk1[3:0] = 0001:
CHclk1[3:0] = 0010:
CHclk1[3:0] = 0011:
CHclk1[3:0] = 0100:
CHclk1[3:0] = 0101:
CHclk1[3:0] = 0110:
CHclk1[3:0] = 0111:
CHclk1[3:0] = 1000:
the output of chclk1 is set to high permanently (default);
chclk1 outputs a digital signal with the frequency of 1000/2 Hz;
chclk1 outputs a digital signal with the frequency of 1000/4 Hz;
chclk1 outputs a digital signal with the frequency of 1000/6 Hz;
chclk1 outputs a digital signal with the frequency of 1000/8 Hz;
chclk1 outputs a digital signal with the frequency of 1000/10 Hz;
chclk1 outputs a digital signal with the frequency of 1000/12 Hz;
chclk1 outputs a digital signal with the frequency of 1000/14 Hz;
chclk1 outputs a digital signal with the frequency of 1000/16 Hz;
b7
b6
b5
b4
b3
b2
b1
b0
Command
R
/W
0
1
0
0
0
0
0
b7
b6
b5
b4
b3
b2
b1
b0
Command
1
0
1
0
0
0
0
1
b7
b6
b5
b4
b3
b2
b1
b0
Command
1
0
1
0
0
0
1
0
b7
b6
b5
b4
b3
b2
b1
b0
Command
1
0
1
0
0
0
1
1
b7
b6
b5
b4
b3
b2
b1
b0
Command
R
/W
0
1
0
0
1
0
0
I/O data
Reserved
Chclk2[1]
Chclk2[0]
Chclk1[3]
Chclk1[2]
Chclk1[1]
Chclk1[0]
相關PDF資料 |
PDF描述 |
|---|---|
| IDTAS4624 | 0.5ヘ LOW VOLTAGE, SINGLE SPDT ANALOG SWITCH |
| IDTAS4624DZG | 0.5ヘ LOW VOLTAGE, SINGLE SPDT ANALOG SWITCH |
| IDTAS4684NBG | 0.5 OHM, DUAL SPDT ANALOG SWITCH |
| IDTAS4684NBG8 | 0.5 OHM, DUAL SPDT ANALOG SWITCH |
| IDTAS4684 | 0.5 OHM, DUAL SPDT ANALOG SWITCH |
相關代理商/技術參數 |
參數描述 |
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