DIGITAL SWITCH 512 x 512 DS 5711 d" />
參數(shù)資料
型號： IDT72V70200PFG8
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 13/23頁
文件大?。?/td> 0K
描述： IC DGTL SW 512X512 3.3V 100-TQFP
標(biāo)準(zhǔn)包裝： 750
系列： 72V
類型： 多路復(fù)用器
電路： 1 x 16:16
獨(dú)立電路： 1
電壓電源： 單電源
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-TQFP（14x14）
包裝： 帶卷 (TR)
其它名稱： 72V70200PFG8
20
COMMERCIALTEMPERATURERANGE
IDT72V70200 3.3V TIME SLOT INTERCHANGE
DIGITAL SWITCH 512 x 512
DS
5711 drw15
ADDRESS
tCSS
tDSH
tASW
tCSH
tDDR
tADS
tADH
AD0-AD7
D8-D15
WR
CS
DTA
DATA
ADDRESS
DATA
tRWS
tDWS
tSWD
tDHW
tAKD
AD0-AD7
D8-D15
RD
R/
W
AS
tRWH
tDHR
tAKH
AC ELECTRICAL CHARACTERISTICS - MULTIPLEXED BUS TIMING (MOTOROLA)
Figure 12. Multiplexed Bus Timing (Motorola Mode)
Symbol
Parameter
Min.
Typ.
Max.
Units
Test Conditions
tASW
ALE Pulse Width
20
ns
tADS
Address Setup from AS falling
3
ns
tADH
Address Hold from AS falling
3
ns
tDDR
Data Setup from
DTA LOW on Read
5
ns
CL = 150pF
tCSH
CS Hold after DS falling
0
ns
tCSS
CS Setup from DS rising
0
ns
tDHW
Data Hold after Write
5
ns
tDWS
Data Setup from DS – Write (Fast Write)
20
ns
tSWD
Valid Data Delay on Write (Slow Write)
122
ns
tRWS
R/
W Setup from DS Rising
60
ns
tRWH
R/
W Hold from DS Rising
5
ns
tDHR(1)
Data Hold after Read
10
20
ns
CL = 150pF, RL = 1K
tDSH
DS Delay after AS falling
10
ns
tAKD
Acknowledgment Delay:
Reading/WritingRegisters
43/43
ns
CL = 150pF
Reading/Writing Memory
760/750
ns
CL = 150pF
tAKH(1)
Acknowledgment Hold Time
22
ns
CL = 150pF, RL = 1K
NOTE:
1. High Impedance is measured by pulling to the appropriate rail with R
L, with timing corrected to cancel time taken to discharge CL.
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PDF描述
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參數(shù)描述
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