IDT72V36100/72V36110 3.3V HIGH DENSITY SUPERSYNC IITM <" />
參數(shù)資料
型號(hào)： IDT72V36110L7-5PFI
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 3/48頁
文件大小： 0K
描述： IC FIFO 131KX36 7-5NS 128QFP
標(biāo)準(zhǔn)包裝： 36
系列： 72V
功能： 同步
存儲(chǔ)容量： 4.7M（131K x 36）
數(shù)據(jù)速率： 166MHz
訪問時(shí)間： 5ns
電源電壓： 3.15 V ~ 3.45 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 128-LQFP
供應(yīng)商設(shè)備封裝： 128-TQFP（14x20）
包裝： 托盤
其它名稱： 72V36110L7-5PFI
11
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72V36100/72V36110 3.3V HIGH DENSITY SUPERSYNC IITM 36-BIT FIFO
65,536 x 36 and 131,072 x 36
OCTOBER 22, 2008
6117 drw04
330
30pF*
510
3.3V
D.U.T.
Input Pulse Levels
GND to 3.0V
Input Rise/Fall Times
3ns(1)
Input Timing Reference Levels
1.5V
OutputReferenceLevels
1.5V
Output Load for tCLK = 10ns, 15 ns
See Figure 2a
Output Load for tCLK = 6ns, 7.5ns
See Figure 2b & 2c
AC TEST CONDITIONS
Figure 2b. AC Test Load
Figure 2c. Lumped Capacitive Load, Typical Derating
AC TEST LOADS - 6ns, 7.5ns Speed Grade
Figure 2a. Output Load
* Includes jig and scope capacitances.
ACTESTLOADS-10ns,15nsSpeedGrades
NOTE:
1. For 166MHz and 133MHz operation input rise/fall times are 1.5ns.
6117 drw04a
50
1.5V
I/O
Z0 = 50
6117 drw04b
6
5
4
3
2
1
20 30 50
80 100
200
Capacitance (pF)
tCD
(Typical,
ns)
VIH
OE
VIL
tOE & tOLZ
VCC
2
VCC
2
100mV
tOHZ
100mV
Output
Normally
LOW
Output
Normally
HIGH
VOL
VOH
VCC
2
VCC
2
6117 drw04c
Output
Enable
Output
Disable
OUTPUT ENABLE & DISABLE TIMING
相關(guān)PDF資料
PDF描述
MS3128E14-19SX CONN RCPT 19POS WALL MNT W/SCKT
MAX11044ETN+T ADC 16BIT SAMPLING 4CH 56-TQFN
IDT72V36110L6PF IC FIFO SYNC 131KX36 6NS 128QFP
IDT72V2113L6PF IC FIFO SUPERSYNCII 6NS 80-TQFP
IDT72T36115L10BB IC FIFO 131KX36 10NS 240BGA
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參數(shù)描述
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