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參數(shù)資料
型號: IDT72T36135ML6BB
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 2/48頁
文件大小: 0K
描述: IC FIFO 1MX18 6NS 240BGA
標準包裝: 1
系列: 72T
功能: 異步,同步
存儲容量: 18M(1M x 18)
數(shù)據(jù)速率: 166MHz
訪問時間: 3.8ns
電源電壓: 2.375 V ~ 2.625 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 240-BGA
供應(yīng)商設(shè)備封裝: 240-PBGA(19x19)
包裝: 托盤
其它名稱: 72T36135ML6BB
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T36135M 2.5V 18M-BIT TeraSync
36-BIT FIFO
524,288 x 36
10
FEBRUARY 04, 2009
AC ELECTRICAL CHARACTERISTICS(1)— SYNCHRONOUS TIMING
(Commercial: VCC = 2.5V
± 5%, TA = 0°C to +70°C;Industrial: VCC = 2.5V ± 5%, TA = -40°C to +85°C)
NOTES:
1. All AC timings apply to both Standard IDT mode and First Word Fall Through mode.
2. Pulse widths less than minimum values are not allowed.
3. Values guaranteed by design, not currently tested.
4. Industrial temperature range product for 6ns speed grade is available as a standard device. All other speed grades are available by special order.
Commercial
Com’l & Ind’l
IDT72T36135ML5
IDT72T36135ML6
Symbol
Parameter
Min.
Max.
Min.
Max.
Unit
fC
Clock Cycle Frequency (Synchronous)
200
166
MHz
tA
Data Access Time
0.6
3.6
0.6
3.8
ns
tCLK
Clock Cycle Time
5
6
ns
tCLKH
Clock High Time
2.5
3.0
ns
tCLKL
Clock Low Time
2.5
3.0
ns
tDS
Data Setup Time
1.5
2.0
ns
tDH
Data Hold Time
0.5
0.5
ns
tENS
Enable Setup Time
1.5
2.0
ns
tENH
Enable Hold Time
0.5
0.5
ns
tLDS
Load Setup Time
1.5
2.0
ns
tLDH
Load Hold Time
0.5
0.5
ns
tWCSS
WCS setup time
1.5
2.0
ns
tWCSH
WCS hold time
0.5
0.5
ns
fS
Clock Cycle Frequency (SCLK)
10
10
MHz
tSCLK
Serial Clock Cycle
100
100
ns
tSCKH
Serial Clock High
45
45
ns
tSCKL
Serial Clock Low
45
45
ns
tSDS
Serial Data In Setup
15
15
ns
tSDH
Serial Data In Hold
5
5
ns
tSENS
Serial Enable Setup
5
5
ns
tSENH
Serial Enable Hold
5
5
ns
tRS
Reset Pulse Width(3)
10
10
ns
tRSS
Reset Setup Time
15
15
ns
tHRSS
HSTL Reset Setup Time
4
4
s
tRSR
Reset Recovery Time
10
10
ns
tRSF
Reset to Flag and Output Time
15
15
ns
tWFF
Write Clock to
FF[1:2] or IR[1:2]
3.6
3.7
ns
tREF
Read Clock to
EF[1:2] or OR[1:2]
3.6
3.7
ns
tPAFS
Write Clock to Synchronous
PAF[1:2]
3.6
3.7
ns
tPAES
Read Clock to Synchronous
PAE[1:2]
3.6
3.7
ns
tRCSLZ
RCLK to Active from High-Z(3)
3.6
3.7
ns
tRCSHZ
RCLK to High-Z(3)
3.6
3.7
ns
tSKEW1
Skew time between RCLK and WCLK for
EF[1:2] and FF[1:2]
—4
5
ns
tSKEW2
Skew time between RCLK and WCLK for
PAE[1:2] and PAF[1:2]
—5
6
ns
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PDF描述
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IDT72T3645L5BB 功能描述:IC FIFO 1024X36 5NS 208-BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標準包裝:90 系列:7200 功能:同步 存儲容量:288K(16K x 18) 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP(14x14) 包裝:托盤 其它名稱:72271LA10PF
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