參數(shù)資料
型號: IDT71256L35PI
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: SRAM
英文描述: 32K X 8 STANDARD SRAM, 35 ns, PDIP28
封裝: 0.600 INCH, PLASTIC, DIP-28
文件頁數(shù): 8/10頁
文件大?。?/td> 108K
代理商: IDT71256L35PI
6.42
IDT71256S/L
CMOS Static RAM 256K (32K x 8-Bit)
Military, Commercial, and Industrial Temperature Ranges
7
NO
T RECOMMENDED
FOR
NEW
DESIGNS
Timing Waveform of Read Cycle No. 2(1,2,4)
NOTES:
1.
WE is HIGH for Read Cycle.
2. Device is continuously selected,
CS is LOW.
3. Address valid prior to or coincident with
CS transition LOW.
4.
OE is LOW.
5. Transition is measured ±200mV from steady state.
Timing Waveform of Read Cycle No. 1(1)
ADDRESS
CS
OE
DATAOUT
tRC
tAA
tOH
tOE
tACS
tCLZ (5)
tOLZ (5)
2946 drw 07
tCHZ(5)
tOHZ(5)
2946 drw 08
ADDRESS
DATAOUT
tRC
tAA
tOH
,
Timing Waveform of Read Cycle No. 2(1,3,4)
CS
DATAOUT
tACS
tCLZ (5)
2946 drw 09
tCHZ(5)
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PDF描述
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參數(shù)描述
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