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參數資料
| 型號： | IDT70V18L20PF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | HIGH-SPEED 3.3V 64K x 9 DUAL-PORT STATIC RAM |
| 中文描述： | 64K X 9 DUAL-PORT SRAM, 20 ns, PQFP100 |
| 封裝： | TQFP-100 |
| 文件頁數： | 9/17頁 |
| 文件大?。?/td> | 146K |
| 代理商： | IDT70V18L20PF |
9
IDT70V18L
High-Speed 3.3V 64K x 9 Dual-Port Static RAM Industrial and Commercial Temperature Ranges
Preliminary
)8;*4'8)!94*'
#
NOTES:
1. D
OR
= D
OL
= V
IL
,
CE
L
=
CE
R
= V
IH
(Refer to Chip Enable Truth Table).
2. All timng is the same for left and right ports. Port "A" may be either left or right port. "B" is the opposite fromport "A".
3. This parameter is measured fromR/
W
"A"
or
SEM
"A"
going HIGH to R/
W
"B"
or
SEM
"B"
going HIGH.
4. If t
SPS
is not satisfied, the semaphore will fall positively to one side or the other, but there is no guarantee which side will be granted the semaphore flag.
)8;*48
!"!#
NOTES:
1.
CE
= V
IH
for the duration of the above timng (both write and read cycle) (Refer to Chip Enable Truth Table).
2. "DATA
OUT
VALID" represents all I/O's (I/O
0
- I/O
8
) equal to the semaphore value.
SEM
4854 drw 09
t
AW
t
EW
I/O
VALID ADDRESS
t
SAA
R/
W
t
WR
t
OH
t
ACE
VALID ADDRESS
DATA
VALID
IN
DATA
OUT
VALID
(2)
t
DW
t
WP
t
DH
t
AS
t
SWRD
t
AOE
Read Cycle
Write Cycle
A
0
-A
2
OE
t
SOP
t
SOP
SEM
"A"
4854 drw 10
t
SPS
MATCH
R/
W
"A"
MATCH
A
0"A"
-A
2"A"
SIDE
"A"
(2)
SEM
"B"
R/
W
"B"
A
0"B"
-A
2"B"
SIDE
"B"
(2)
相關PDF資料 |
PDF描述 |
|---|---|
| IDT70V18L20PFI | HIGH-SPEED 3.3V 64K x 9 DUAL-PORT STATIC RAM |
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| IDT70V24L55PFI | HIGH-SPEED 3.3V 4K x 16 DUAL-PORT STATIC RAM |
| IDT70V24S15G | HIGH-SPEED 3.3V 4K x 16 DUAL-PORT STATIC RAM |
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相關代理商/技術參數 |
參數描述 |
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