參數(shù)資料
型號(hào): ICS87973DYI-147LFT
廠商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 19/19頁(yè)
文件大?。?/td> 0K
描述: IC CLK MULT/ZD BUFFER 52TQFP
標(biāo)準(zhǔn)包裝: 500
系列: HiPerClockS™
類型: *
PLL: 帶旁路
輸入: HCSL,LVCMOS,LVDS,LVHSTL,LVPECL,LVTTL,SSTL
輸出: LVCMOS,LVTTL
電路數(shù): 1
比率 - 輸入:輸出: 3:12
差分 - 輸入:輸出: 是/無(wú)
頻率 - 最大: 150MHz
除法器/乘法器: 是/無(wú)
電源電壓: 3.135 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 52-LQFP
供應(yīng)商設(shè)備封裝: 52-TQFP(10x10)
包裝: 帶卷 (TR)
ICS87973I-147
LOW SKEW, 1-TO-12, LVCMOS/LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER
IDT / ICS LVCMOS CLOCK MULTIPLIER/ZERO DELAY BUFFER
9
ICS87973DYI-147 REV. A DECEMBER 9, 2008
Parameter Measurement Information
LVCMOS Output Load AC Test Circuit
Cycle-to-Cycle Jitter
LVCMOS Static Phase Offset
Differential Input Level
Output Skew
Differential Static Phase Offset
SCOPE
Qx
LVCMOS
GND
VDD,
1.65V±5%
-1.65V±5%
VDDO
VDDA,
V
DDO
2
V
DDO
2
V
DDO
2
tcycle n
tcycle n+1
tjit(cc) =
|tcycle n – tcycle n+1|
1000 Cycles
QA[0:3],
QB[0:3],
QC[0:3],
QSYNC,
QFB
t()
V
DD
2
V
DD
2
t() mean = Static Phase Offset
Where t() is any random sample, and t() mean is the
average of the sampled cycles measured on controlled edges
CLK0,
CLK1
EXT_FB
V
CMR
Cross Points
V
PP
VDD
GND
nCLK
CLK
tsk(o)
Qx
Qy
t()
V
DD
2
V
DD
2
t() mean = Static Phase Offset
Where t() is any random sample, and t() mean is the
average of the sampled cycles measured on controlled edges
nCLK
EXT_FB
nCLK
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參數(shù)描述
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