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參數(shù)資料
| 型號： | IBM25PPC405EP-3GB133C |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 133.33 MHz, RISC PROCESSOR, PBGA385 |
| 封裝： | 31 MM, ENHANCED, PLASTIC, BGA-385 |
| 文件頁數(shù)： | 42/52頁 |
| 文件大?。?/td> | 992K |
| 代理商： | IBM25PPC405EP-3GB133C |
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Preliminary
PowerPC 405EP Embedded Processor Data Sheet
6/9/03
Page 47 of 52
Notes: 1. In the following I/O Specifications tables a timing value of na means “not applicable” and dc means
“don’t care.”
2. See “Test Conditions” on page 42 for output capacitive loading.
I/O Specifications—Group 1 (Part 1 of 2)
Notes:
1. PCI timings are for asynchronous operation up to 66.66MHz. PCI output hold time requirement is 1ns for 66.66MHz
and 2ns for 33.33MHz.
2. Ethernet interface meets timing requirements as defined by IEEE 802.3 standard. Timing shown is with EMAC noise
filter selected. See the CPC0_EPCTL register
PowerPC 405EP Embedded Processor User’s Manual.
3. For PCI, I/O H is specified at 0.9OVDD and I/O L is specified at 0.1OVDD. For all other interfaces, I/O H is specified at
2.4 V and I/O L is specified at 0.4 V.
Signal
Input (ns)
Output (ns)
Output Current (mA)
Clock
Notes
Setup Time
(TIS min)
Hold Time
(TIH min)
Valid Delay
(TOV max)
Hold Time
(TOH min)
I/O H
(min)
I/O L
(min)
PCI Interface
PCIAD31:00
3
0
6
1
0.5
1.5
PCIClk
1
PCIC3:0/BE3:0
3
0
6
1
0.5
1.5
PCIClk
1
PCIClk
na
async
PCIDevSel
3
0
6
1
0.5
1.5
PCIClk
1
PCIFrame
3
0
6
1
0.5
1.5
PCIClk
1
PCIGnt0/Req
PCIGnt1:2
na
6
1
0.5
1.5
PCIClk
1
PCIIDSel
3
0
na
PCIClk
1
PCIINT[PerWE]
na
0.5
1.5
PCIClk
1
PCIIRDY
3
0
6
1
0.5
1.5
PCIClk
1
PCIParity
3
0
6
1
0.5
1.5
PCIClk
1
PCIPErr
3
0
6
1
0.5
1.5
PCIClk
1
PCIReq0/Gnt
PCIReq1:2
5
0
na
PCIClk
1
PCIReset
na
0.5
1.5
PCIClk
1
PCISErr
na
0.5
1.5
PCIClk
1
PCIStop
3
0
6
1
0.5
1.5
PCIClk
1
PCITRDY
3
0
6
1
0.5
1.5
PCIClk
1
Ethernet Interface
EMC0MDClk
na
settable
2
10.3
7.1
async
2
EMC0MDIO
100
0
1 OPB clock
period + 10ns
1 OPB clock
period
10.3
7.1
EMC0MDClk
2
EMC0Tx0:1D3:0
na
14
5
10.3
7.1
PHY0TxClk
2
EMC0Tx0:1En
na
14
5
10.3
7.1
PHY0TxClk
2
EMC0Tx0:1Err
na
14
5
10.3
7.1
PHY0TxClk
2
PHY0Col0:1
2
3
na
PHY0RxClk
2
PHY0CrS0:1
2
3
na
PHY0RxClk
2
PHY0Rx0:1Clk
na
async
2
PHY0Rx0:1D3:0
2
4
na
PHY0RxClk
2
PHY0Rx0:1DV
2
4
na
PHY0RxClk
2
PHY0Rx0:1Err
2
4
na
PHY0RxClk
2
PHY0Tx0:1Clk
na
async
2
相關(guān)PDF資料 |
PDF描述 |
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