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參數資料
| 型號： | HPC167064EL20 |
| 廠商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | High-Performance microController with a 16k UV Erasable CMOS EPROM |
| 中文描述： | UVPROM, MICROCONTROLLER, CQCC68 |
| 封裝： | WINDOWED, LDCC-68 |
| 文件頁數： | 29/34頁 |
| 文件大?。?/td> | 415K |
| 代理商： | HPC167064EL20 |
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20 MHz
AC Electrical Characteristics (Continued)
(See Notes 1 and 4 and
Figures 1 thru 5 ) VCC e 5V g5% TA eb55 Cto a125 C for HPC167064 and VCC e 5V g10%
TA e 0 Cto a70 C for HPC467064 (Continued)
Symbol and Formula
Parameter
Min
Max
Units
Notes
tDC1ALER
Delay from CKI Rising Edge to ALE Rising Edge
0
35
ns
(Notes 1 2)
tDC1ALEF
Delay from CKI Rising Edge to ALE Falling Edge
0
35
ns
(Notes 1 2)
tDC2ALER e
tC a 20
Delay from CK2 Rising Edge to ALE Rising Edge
45
ns
tDC2ALEF e
tC a 20
Delay from CK2 Falling Edge to ALE Falling Edge
45
ns
tLL e
tC b 9
ALE Pulse Width
41
ns
tST e
tC b 7
Setup of Address Valid before ALE Falling Edge
18
ns
tVP e
tC b 5
Hold of Address Valid after ALE Falling Edge
20
ns
tARR e
tC b 5
ALE Falling Edge to RD Falling Edge
20
ns
tACC e tC a WS b 55
Data Input Valid after Address Output Valid
145
ns
tRD e
tC a WS b 65
Data Input Valid after RD Falling Edge
85
ns
tRW e
tC a WS b 10
RD Pulse Width
140
ns
tDR e
tC b 15
Hold of Data Input Valid after RD Rising Edge
0
60
ns
tRDA e tC b 15
Bus Enable after RD Rising Edge
85
ns
tARW e
tC b 5
ALE Falling Edge to WR Falling Edge
45
ns
tWW e
tC a WS b 15
WR Pulse Width
160
ns
tV e
tC a WS b 5
Data Output Valid before WR Rising Edge
145
ns
tHW e
tC b 5
Hold of Data Valid after WR Rising Edge
20
ns
tDAR e
tC a WS b 50
Falling Edge of ALE to Falling Edge of RDY
75
ns
tRWR e tC
RDY Pulse Width
100
ns
Address
Cycles
Read
Cycles
Write
Cycles
Ready
Input
4
相關PDF資料 |
PDF描述 |
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參數描述 |
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