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參數(shù)資料
| 型號(hào)： | HD404828R |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | AS Microcomputer Incorporating a LCD controller/Driver Circuit(帶LCD控制/驅(qū)動(dòng)電路的微計(jì)算機(jī)) |
| 中文描述： | 由于微機(jī)安裝有LCD控制器/驅(qū)動(dòng)電路（帶液晶控制/驅(qū)動(dòng)電路的微計(jì)算機(jī)） |
| 文件頁數(shù)： | 83/147頁 |
| 文件大?。?/td> | 519K |
| 代理商： | HD404828R |
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HD404829R Series
83
I
÷
2
÷
8
÷
32
÷
128
÷
512
÷
2048
Data bus
Clock line
Signal line
Serial mode
register B
(SMRB)
SCK
S
PER
P
Idle controll
logic
Serial mode
register A
(SMRA)
Clock
Serial data
register (SRL/U)
Serial interrupt
request flag
(IFS)
S
1/2
1/2
SI
System
clock
SO
Octal
counter (OC)
I/O controll
logic
Transfer
control
Figure 70 Block Diagram of Serial Interface
Serial Interface Operation
Selecting and Changing the Operating Mode:
table 22 lists the serial interface’s operating modes. To
select an operating mode, use one of these combinations of port mode register A (PMRA: $004) and serial
mode register A (SMRA: $005) settings; to change the operating mode, always initialize the serial interface
internally by writing data to serial mode register A. Note that the serial interface is initialized by writing
data to serial mode register A. Refer to the following Serial Mode Register A section for details.
Pin Setting:
The R2
1
/
SCK
pin is controlled by writing data to serial mode register A (SMRA: $005). The
R2
2
/SI and R2
3
/SO pins are controlled by writing data to port mode register A (PMRA: $004). Refer to the
following Registers for Serial Interface section for details.
Transmit Clock Source Setting:
The transmit clock source is set by writing data to serial mode register A
(SMRA: $005) and serial mode register B (SMRB: $028). Refer to the following Registers for Serial
Interface section for details.
Data Setting:
Transmit data is set by writing data to the serial data register (SRL: $006, SRU: $007).
Receive data is obtained by reading the contents of the serial data register. The serial data is shifted by the
transmit clock and is input from or output to an external system.
The output level of the SO pin is invalid until the first data is output after MCU reset, or until the output
level control in idle states is performed.
相關(guān)PDF資料 |
PDF描述 |
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