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參數(shù)資料
| 型號(hào)： | HC05 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Bipolar Transistor; Transistor Polarity:Dual P Channel; Power Dissipation:20W; DC Current Gain Min (hfe):25; Collector Current:1A; DC Current Gain Max (hfe):200; Power (Ptot):20W |
| 中文描述： | 高密度互補(bǔ)金屬氧化物半導(dǎo)體（HCMOS）微控制器 |
| 文件頁數(shù)： | 198/232頁 |
| 文件大小： | 1095K |
| 代理商： | HC05 |
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MOTOROLA
B-14
MC68HC05X16
Rev. 1
MC68HC705X32
15
B.8
Bootstrap mode
Oscillator divide-by-two is forced in bootstrap mode; all other options stay as programmed in the
mask options register (see
Section B.7
).
The bootstrap firmware is located in mask ROM at address locations $0200 to $024F, $03B0 to
$3FFF, $7E00 to $7FDD and $7FE0 to $7FEF. This firmware can be used to program the EPROM
and the EEPROM, to check if the EPROM is erased, or to load and execute routines in RAM.
After reset, while going to the bootstrap mode, the vector located at address $7FEE and $7FEF
(RESET) is fetched to start execution of the bootstrap program. To place the part in bootstrap
mode, the following conditions must be met during transition of the RESET pin from low to high:
1) IRQ pin at 2xV
DD
or MDS pin at V
DD
2) TCAP1 pin at V
DD
3) TCAP2 pin at V
SS
The hold time on the IRQ, MDS, TCAP1 and TCAP2 pins is two clock cycles after the external
RESET pin is brought high.
When the MC68HC705X32 is placed in the bootstrap mode, the bootstrap reset vector will be
fetched and the bootstrap firmware will start to execute.
Table B-5
shows the conditions required
to enter each level of bootstrap mode on the rising edge of RESET
The bootstrap program first copies part of itself into RAM (except ‘RAM parallel load’), as the
program cannot be executed in ROM during verification/programming of the EPROM.
Table B-5
Mode of operation selection
MDS
V
SS
IRQ
TCAP1
TCAP2
x
PD1 PD2 PD3 PD4
x
x
Mode
AND V
SS
to V
DD
V
SS
to V
DD
x
x
Single-chip mode
Bootstrap mode:
EPROMerase check
EPROMerase check, erase EEPROM parallel
EPROM/EEPROMprogram/verify
Parallel EEPROMonly verify (SEC bit not active)
EPROMerase check, erase EEPROM parallel EPROM
only program/verify
Jump to RAM$0051 (SEC bit not active)
Serial RAMload and execute (SEC bit not active)
V
DD
OR
2V
DD
V
DD
V
SS
0
0
0
x
V
DD
OR
2V
DD
V
DD
V
SS
1
0
0
x
V
DD
OR
2V
DD
V
DD
V
SS
0
1
0
x
V
DD
OR
2V
DD
V
DD
V
SS
1
1
0
x
V
DD
V
DD
x = Dont care
OR
OR
2V
DD
2V
DD
V
DD
V
DD
V
SS
V
SS
x
x
1
x
1
1
0
1
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