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參數(shù)資料
| 型號： | HC05 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Bipolar Transistor; Transistor Polarity:Dual P Channel; Power Dissipation:20W; DC Current Gain Min (hfe):25; Collector Current:1A; DC Current Gain Max (hfe):200; Power (Ptot):20W |
| 中文描述： | 高密度互補金屬氧化物半導體（HCMOS）微控制器 |
| 文件頁數(shù)： | 106/232頁 |
| 文件大小： | 1095K |
| 代理商： | HC05 |
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MOTOROLA
7-4
MC68HC05X16
Rev. 1
SERIAL COMMUNICATIONS INTERFACE
7
When SCDR is read, it contains the last data byte received, provided that the receiver is enabled.
The receive data register full flag bit (RDRF) in the SCSR is set to indicate that a data byte has
been transferred from the input serial shift register to the SCDR; this will cause an interrupt if the
receiver interrupt is enabled. The data transfer from the input serial shift register to the SCDR is
synchronized by the receiver bit rate clock. The OR (overrun), NF (noise), or FE (framing) error
flags in the SCSR may be set if data reception errors occurred.
An idle line interrupt is generated if the idle line interrupt is enabled and the IDLE bit (which detects
idle line transmission) in SCSR is set. This allows a receiver that is not in the wake-up mode to
detect the end of a message or the preamble of a new message, or to resynchronize with the
transmitter. A valid character must be received before the idle line condition or the IDLE bit will not
be set and idle line interrupt will not be generated.
The SCP0 and SCP1 bits function as a prescaler for SCR0–SCR2 to generate the receiver baud rate
and for SCT0–SCT2 to generate the transmitter baud rate. Together, these eight bits provide multiple
transmitter/receiver rate combinations for a given crystal frequency (see
Figure 7-2
). This register
should only be written to while both the transmitter and receiver are disabled (TE=0, RE=0).
Figure 7-2
SCI rate generator division
SCP1
SPC0
SCT2
SCT1
SCT0
SCR2
SCR1
SCR0
Internal processor clock
SCP0 – SCP1
prescaler
rate control
(
NP)
SCR0 – SCR2
receiver
(
NR)
SCT0 – SCT2
transmtter
rate control
(
NT)
÷
16
Transmtter clock
Receiver clock
rate control
7
6
5
4
3
2
1
0
$000D
Baud rate register
Note:
There is a fixed rate divide-by-16 before the transmitter to compensate for the inherent divide-by-16 of
the receiver (sampling). This means that by loading the same value for both the transmitter and receiver
baud rate selector, the same baud rates can be obtained.
相關PDF資料 |
PDF描述 |
|---|---|
| HC1-5502A-7 | Subscriber Line Interface Circuit |
| HC4P-5502A-7 | Subscriber Line Interface Circuit |
| HC1062A | Low Voltage Telephone Speech Transmission Circuit / High/Low Level Mute |
| HC1198 | Peripheral IC |
| HC1199 | Peripheral IC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| HC0502 | 制造商:Alltrade Tools LLC 功能描述:12OZ CROSS PEIN HAMMER |
| HC0503 | 制造商:Alltrade Tools LLC 功能描述:HAMMER-BALL PEIN 4OZ |
| HC0504 | 制造商:Alltrade Tools LLC 功能描述:HAMMER-BALL PEIN 8OZ |
| HC0505 | 制造商:Alltrade Tools LLC 功能描述:HAMMER-BALL PEIN 1LB |
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