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參數(shù)資料
| 型號： | H8S2140BF-ZTAT |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Hitachi 16-Bit Single-Chip Microcomputer |
| 中文描述： | 日立16位單片機 |
| 文件頁數(shù)： | 20/829頁 |
| 文件大?。?/td> | 4316K |
| 代理商： | H8S2140BF-ZTAT |
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Rev. 2.0, 08/02, page xviii of xxxviii
17.4.8 KCLK Fall Interrupt Operation............................................................................480
Usage Notes.......................................................................................................................481
17.5.1 KBIOE Setting and KCLK Falling Edge Detection.............................................481
17.5.2 Module Stop Mode Setting ..................................................................................481
17.5
Section 18 Host Interface X-Bus Interface (XBS)............................................483
18.1
Features.............................................................................................................................483
18.2
Input/Output Pins ..............................................................................................................485
18.3
Register Descriptions ........................................................................................................486
18.3.1 System Control Register 2 (SYSCR2) .................................................................486
18.3.2 Host Interface Control Register (HICR) Host Interface Control Register 2
(HICR2)................................................................................................................488
18.3.3 Input Data Register (IDR)....................................................................................491
18.3.4 Output Data Register 1 (ODR).............................................................................491
18.3.5 Status Register (STR)...........................................................................................492
18.4
Operation...........................................................................................................................493
18.4.1 Host Interface Activation.....................................................................................493
18.4.2 Control States.......................................................................................................495
18.4.3 A20 Gate..............................................................................................................495
18.4.4 Host Interface Pin Shutdown Function ................................................................497
18.5
Interrupt Sources...............................................................................................................499
18.5.1 IBF1, IBF2, IBF3, and IBF4................................................................................499
18.5.2 HIRQ11, HIRQ1, HIRQ12, HIRQ3, and HIRQ4 ................................................499
18.6
Usage Notes.......................................................................................................................501
18.6.1 Note on Host Interface.........................................................................................501
18.6.2 Module Stop Mode Setting ..................................................................................501
Section 19 Host Interface LPC Interface (LPC)................................................503
19.1
Features.............................................................................................................................503
19.2
Input/Output Pins ..............................................................................................................505
19.3
Register Descriptions ........................................................................................................506
19.3.1 Host Interface Control Registers 0 and 1 (HICR0, HICR1).................................507
19.3.2 Host Interface Control Registers 2 and 3 (HICR2, HICR3).................................514
19.3.3 LPC Channel 3 Address Register (LADR3) ........................................................517
19.3.4 Input Data Registers 1 to 3 (IDR1 to IDR3).........................................................518
19.3.5 Output Data Registers 1 to 3 (ODR1 to ODR3)...................................................519
19.3.6 Bidirectional Data Registers 0 to 15 (TWR0 to TWR15)....................................529
19.3.7 Status Registers 1 to 3 (STR1 to STR3)...............................................................520
19.3.8 SERIRQ Control Registers 0 and 1 (SIRQCR0, SIRQCR1)................................527
19.3.9 Host Interface Select Register (HISEL)...............................................................535
19.4
Operation...........................................................................................................................536
19.4.1 Host Interface Activation.....................................................................................536
19.4.2 LPC I/O Cycles....................................................................................................537
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| H8S2161B | Hitachi 16-Bit Single-Chip Microcomputer |
| H8S2141BF-ZTAT | Hitachi 16-Bit Single-Chip Microcomputer |
| H8S2145BF-ZTAT | Hitachi 16-Bit Single-Chip Microcomputer |
| H8S2166 | Renesas 16-Bit Single-Chip Microcomputer |
| H8S2167 | Renesas 16-Bit Single-Chip Microcomputer |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| H8S2141BF-ZTAT | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Hitachi 16-Bit Single-Chip Microcomputer |
| H8S2144 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:HARDWARE MANUAL |
| H8S2145BF-ZTAT | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Hitachi 16-Bit Single-Chip Microcomputer |
| H8S2148BF-ZTAT | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Hitachi 16-Bit Single-Chip Microcomputer |
| H8S2153 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:16-Bit Single-Chip Microcomputer H8S Family / H8S/2100 Series |
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