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參數資料
| 型號： | GMS90L320 |
| 英文描述： | 8-Bit Single-Chip Microcontrollers(低電壓,8位單片微控制器) |
| 中文描述： | 8位單芯片微控制器（低電壓，8位單片微控制器） |
| 文件頁數： | 39/46頁 |
| 文件大?。?/td> | 683K |
| 代理商： | GMS90L320 |
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GMS90C320
OCT. 2000 Ver 1.2
35
AC Characteristics for 50MHz
External Data Memory Characteristics
Advance Information (50MHz)
External Clock Drive
Parameter
Symbol
at 50 MHz Clock
Variable Clock
1/t
CLCL
= 3.5 to 50MHz
Unit
Min.
Max.
Min.
Max.
RD pulse width
t
RLRH
90
-
6t
CLCL
-30
-
ns
WR pulse width
t
WLWH
90
-
6t
CLCL
-30
-
ns
Address hold after ALE
t
LLAX2
25
-
2t
CLCL
-15
-
ns
RD to valid data in
t
RLDV
-
60
-
5t
CLCL
-40
ns
Data hold after RD
t
RHDX
0
-
0
-
ns
Data float after RD
t
RHDZ
-
28
-
2t
CLCL
-12
ns
ALE to valid data in
t
LLDV
-
120
-
8t
CLCL
-40
ns
Address to valid data in
t
AVDV
-
125
-
9t
CLCL
-55
ns
ALE to WR or RD
t
LLWL
45
75
3t
CLCL
-15
3t
CLCL
+15
ns
Address valid to WR or RD
t
AVWL
50
-
4t
CLCL
-30
-
ns
WR or RD high to ALE high
t
WHLH
5
35
t
CLCL
-15
t
CLCL
+15
ns
Data valid to WR transition
t
QVWX
5
-
t
CLCL
-15
-
ns
Data setup before WR
t
QVWH
100
-
7t
CLCL
-40
-
ns
Data hold after WR
t
WHQX
5
-
t
CLCL
-15
-
ns
Address float after RD
t
RLAZ
-
0
-
0
ns
Parameter
Symbol
Variable Oscillator
(Freq. = 3.5 to 50MHz)
Unit
Min.
Max.
Oscillator period
t
CLCL
20
285.7
ns
High time
t
CHCX
10
t
CLCL
- t
CLCX
ns
Low time
t
CLCX
10
t
CLCL
- t
CHCX
ns
Rise time
t
CLCH
-
10
ns
Fall time
t
CHCL
-
10
ns
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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