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參數(shù)資料
| 型號： | EPF81188AQC208-4 |
| 廠商： | Altera |
| 文件頁數(shù)： | 45/62頁 |
| 文件大小： | 0K |
| 描述： | IC FLEX 8000A FPGA 12K 208-PQFP |
| 產(chǎn)品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 72 |
| 系列： | FLEX 8000 |
| LAB/CLB數(shù)： | 126 |
| 邏輯元件/單元數(shù)： | 1008 |
| 輸入/輸出數(shù)： | 148 |
| 門數(shù)： | 12000 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 208-BFQFP |
| 供應商設(shè)備封裝： | 208-PQFP（28x28） |
| 其它名稱： | 544-2248 |
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Altera Corporation
5
FLEX 8000 Programmable Logic Device Family Data Sheet
FL
EX
800
0
3
Figure 1 shows a block diagram of the FLEX 8000 architecture. Each group
of eight LEs is combined into an LAB; LABs are arranged into rows and
columns. The I/O pins are supported by I/O elements (IOEs) located at
the ends of rows and columns. Each IOE contains a bidirectional I/O
buffer and a flipflop that can be used as either an input or output register.
Figure 1. FLEX 8000 Device Block Diagram
Signal interconnections within FLEX 8000 devices and between device
pins are provided by the FastTrack Interconnect, a series of fast,
continuous channels that run the entire length and width of the device.
IOEs are located at the end of each row (horizontal) and column (vertical)
FastTrack Interconnect path.
IOE
I/O Element
(IOE)
Logic Array
Block (LAB)
Logic
Element (LE)
FastTrack
Interconnect
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