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參數(shù)資料
| 型號： | EP7312-CV-90 |
| 廠商： | CIRRUS LOGIC INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | HIGH-PERFORMANCE, LOW-POWER SYSTEM ON CHIP WITH SDRAM AND ENHANCED DIGITAL AUDIO INTERFACE |
| 中文描述： | 32-BIT, FLASH, 90 MHz, RISC MICROCONTROLLER, PQFP208 |
| 封裝： | LQFP-208 |
| 文件頁數(shù)： | 42/64頁 |
| 文件大?。?/td> | 1710K |
| 代理商： | EP7312-CV-90 |
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42
Copyright Cirrus Logic, Inc. 2003
(All Rights Reserved)
DS508PP5
EP7312
High-Performance, Low-Power System on Chip
C20
nPOR
Schmitt
I
Power-on reset input
D1
PB[7]
1
Input
I
GPIO port B
D2
RXD[2]
I
UART 2 receive data input
D3
VDDIO
Pad power
Digital I/O power, 3.3V
D18
VSSIO
Pad ground
I/O ground
D19
nBATCHG
I
Battery changed sense input
D20
A[7]
1
Low
O
System byte address
E1
PB[4]
1
Input
I
GPIO port B
E2
TXD[2]
1
High
O
UART 2 transmit data output
E3
WRITE/nSDRAS
1
Low
O
Transfer direction / SDRAM RAS signal output
E18
nMEDCHG/nBROM
I
Media change interrupt input / internal ROM boot enable
E19
nEXTPWR
I
External power supply sense input
E20
D[9]
1
Low
I/O
Data I/O
F1
PB[3]
1
Input
I/O
GPIO port B
F2
PB[6]
1
Input
I/O
GPIO port B
F3
TDI
with p/u*
I
JTAG data input
F18
D[7]
1
Low
I/O
Data I/O
F19
A[8]
1
Low
O
System byte address
F20
D[10]
1
Low
I/O
Data I/O
G1
PB[1]
1
Input
I/O
G2
PB[2]
1
Input
I/O
GPIO port B
G3
PB[5]
1
Input
I/O
GPIO port B
G18
D[8]
1
Input
I/O
Data I/O
G19
A[9]
1
Low
O
System byte address
G20
D[11]
1
Low
I/O
Data I/O
H1
PA[7]
1
Input
I/O
GPIO port A
H[2]
TDO
1
Input
O
JTAG data out
H[3]
PB[0]
1
Input
I/O
GPIO port B
H[18]
A[10]
1
Low
O
System byte address
H19
D[12]
1
Low
I/O
Data I/O
H20
A[12]
1
Low
O
System byte address
J1
PA[4]
1
Input
I/O
GPIO port A
Table 21. 204-Ball TFBGA Ball Listing (Continued)
Ball Location
Name
Strength
Reset
State
Type
Description
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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