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參數(shù)資料
型號： EP2SGX90EF1152C4ES
廠商： Altera
文件頁數(shù)： 657/1486頁
文件大?。?/td> 0K
描述： IC STRATIX II GX 90K 1152-FBGA
標(biāo)準(zhǔn)包裝： 0
系列： Stratix® II GX
LAB/CLB數(shù)： 4548
邏輯元件/單元數(shù)： 90960
RAM 位總計： 4520448
輸入/輸出數(shù)： 558
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 1152-BBGA
供應(yīng)商設(shè)備封裝： 1152-FBGA（27x27）
配用： 544-1725-ND - PCIE KIT W/S II GX EP2SGX90N
544-1724-ND - SI KIT W/SII GX EP2SGX90N
544-1702-ND - VIDEO KIT W/SII GX EP2SGX90N
其它名稱： 544-1764
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Altera Corporation
4–71
June 2009
Stratix II GX Device Handbook, Volume 1
DC and Switching Characteristics
tINREG2PIPE9
Input register to
DSP block pipeline
register in 9 × 9-bit
mode
1312
2030
1312
2131
1312
2266
1312
2720
ps
tINREG2PIPE18
Input register to
DSP block pipeline
register in 18 × 18-
bit mode
1302
2010
1302
2110
1302
2244
1302
2693
ps
tINREG2PIPE36
Input register to
DSP block pipeline
register in 36 × 36-
bit mode
1302
2010
1302
2110
1302
2244
1302
2693
ps
tPIPE2OUTREG2ADD DSP block pipeline
register to output
register delay in
two-multipliers
adder mode
924
1450
924
1522
924
1618
924
1943
ps
tPIPE2OUTREG4ADD DSP block pipeline
register to output
register delay in
four-multipliers
adder mode
1134
1850
1134
1942
1134
2065
1134
2479
ps
tPD9
Combinational input
to output delay for
9×9
2100
2880
2100
3024
2100
3214
2100
3859
ps
tPD18
Combinational input
to output delay for
18 × 18
2110
2990
2110
3139
2110
3337
2110
4006
ps
tPD36
Combinational input
to output delay for
36 × 36
2939
4450
2939
4672
2939
4967
2939
5962
ps
tCLR
Minimum clear pulse
width
2212
2322
2469
2964
ps
tCLKL
Minimum clock low
time
1190
1249
1328
1594
ps
tCLKH
Minimum clock high
time
1190
1249
1328
1594
ps
(1)
This column refers to –3 speed grades for EP2SGX30, EP2SGX60, and EP2SGX90 devices.
(2)
This column refers to –3 speed grades for EP2SGX130 devices.
Table 4–58. DSP Block Internal Timing Microparameters (Part 2 of 2)
Symbol
Parameter
-3 Speed
Grade (1)
-3 Speed
Grade (2)
-4 Speed
Grade
-5 Speed
Grade
Unit
Min
Max
Min
Max
Min
Max
Min
Max
相關(guān)PDF資料
PDF描述
EP2SGX90EF1152C3ES IC STRATIX II GX 90K 1152-FBGA
EP2SGX130GF40C5NES IC STRATIX II GX 130K 1508-FBGA
AT6002A-4AC IC FPGA 6K GATE 4NS 144TQFP
AT6002A-2AI IC FPGA 2NS 144PIN TQFP
EP20K100EQI240-2X IC APEX 20KE FPGA 100K 240-PQFP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
EP2SGX90EF1152C4N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II GX 4548 LABs 558 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX90EF1152C5 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II GX 4548 LABs 558 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX90EF1152C5ES 功能描述:IC STRATIX II GX 90K 1152-FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Stratix® II GX 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標(biāo)準(zhǔn)包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計:3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA（34.55x34.55）
EP2SGX90EF1152C5N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II GX 4548 LABs 558 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX90EF1152I4 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II GX 4548 LABs 558 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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