參數(shù)資料
型號： EP20K400ERI240-2
廠商： ALTERA CORP
元件分類： PLD
英文描述： LOADABLE PLD, PQFP240
封裝： HEAT SINK, POWER, QFP-240
文件頁數(shù)： 42/65頁
文件大?。?/td> 781K
代理商： EP20K400ERI240-2
Altera Corporation
69
Preliminary Information
APEX 20K Programmable Logic Device Family Data Sheet
Figure 31. Specications for the Incoming & Generated Clocks
The tI parameter refers to the nominal input clock period; the tO parameter refers to the
nominal output clock period.
Table 10 summarizes the ClockLock and ClockBoost parameters for
APEX 20K devices. Specifications for APEX 20KE devices will be released
in a future data sheet.
Input
Clock
ClockLock
Generated
Clock
f CLK1 f CLK2
f CLK4
t INDUTY
t I + t CLKDEV
t R
t F
t O
t I + t INCLKSTB
t O
tO
t JITTER
tO + t JITTER
tOUTDUTY
,
Table 10. ClockLock & ClockBoost Parameters
Symbol
Parameter
Min
Typ
Max
Unit
tR
Input rise time
5
ns
tF
Input fall time
5
ns
tINDUTY
Input duty cycle
40
60
%
fCLK1
Input clock frequency (ClockBoost clock multiplication factor equals 1)
25
133
MHz
fCLK2
Input clock frequency (ClockBoost clock multiplication factor equals 2)
20
66
MHz
fCLKDEV
Input deviation from user specification in the Quartus software (ClockBoost clock
multiplication factor equals 1)
25,000
PPM
fCLK4
Input clock frequency (ClockBoost clock multiplication factor equals 4)
15
33
MHz
tINCLKSTB
Input clock stability (measured between adjacent clocks)
100
ps
tLOCK
Time required for ClockLock or ClockBoost to acquire lock
10
s
tJITTER
Jitter on ClockLock or ClockBoost-generated clock
250
ps
tOUTDUTY
Duty cycle for ClockLock or ClockBoost-generated clock
40
50
60
%
相關PDF資料
PDF描述
EP20K400ERI240-3 LOADABLE PLD, PQFP240
EP20K400FC672-3X LOADABLE PLD, 3.6 ns, PBGA672
EPB5065G 42 MHz, LOW PASS FILTER
EPC1000P 1-OUTPUT DC-DC REG PWR SUPPLY MODULE
EPC1055PE 1-OUTPUT DC-DC REG PWR SUPPLY MODULE
相關代理商/技術參數(shù)
參數(shù)描述
EP20K400FC672-1 功能描述:FPGA - 現(xiàn)場可編程門陣列 CPLD - APEX 20K 1664 Macros 502 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP20K400FC672-1ES 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA
EP20K400FC672-1X 功能描述:FPGA - 現(xiàn)場可編程門陣列 CPLD - APEX 20K 1664 Macros 502 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP20K400FC672-2 功能描述:FPGA - 現(xiàn)場可編程門陣列 CPLD - APEX 20K 1664 Macros 502 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP20K400FC672-2ES 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA
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