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參數資料
型號： EP1SGX40DF1020C7N
廠商： Altera
文件頁數： 607/1456頁
文件大?。?/td> 0K
描述： IC STRATIX GX FPGA 40K 1020-FBGA
產品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 12
系列： Stratix® GX
LAB/CLB數： 4125
邏輯元件/單元數： 41250
RAM 位總計： 3423744
輸入/輸出數： 624
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1020-BBGA
供應商設備封裝： 1020-FBGA（33x33）
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Altera Corporation
6–21
June 2006
Stratix GX Device Handbook, Volume 1
DC & Switching Characteristics
VOH
High-level output voltage
IOH = 8 mA (1)
VCCIO – 0.4
V
VOL
Low-level output voltage
IOH = –8 mA (1)
0.4
V
Table 6–30. 1.5-V HSTL Class II Specifications
Symbol
Parameter
Conditions
Minimum
Typical
Maximum
Units
VCCIO
Output supply voltage
1.4
1.5
1.6
V
VREF
Input reference voltage
0.68
0.75
0.9
V
VTT
Termination voltage
0.7
0.75
0.8
V
VIH (DC)
DC high-level input voltage
VREF + 0.1
V
VIL (DC)
DC low-level input voltage
–0.3
VREF – 0.1
V
VIH (AC)
AC high-level input voltage
VREF + 0.2
V
VIL (AC)
AC low-level input voltage
VREF – 0.2
V
VOH
High-level output voltage
IOH = 16 mA (1)
VCCIO – 0.4
V
VOL
Low-level output voltage
IOH = –16 mA (1)
0.4
V
Table 6–31. 1.5-V Differential HSTL Specifications
Symbol
Parameter
Conditions
Minimum
Typical
Maximum
Units
VCCIO
I/O supply voltage
1.4
1.5
1.6
V
VDIF (DC)
DC input differential
voltage
0.2
V
VCM (DC)
DC common mode input
voltage
0.68
0.9
V
VDIF (AC)
AC differential input
voltage
0.4
V
Table 6–32. CTT I/O Specifications (Part 1 of 2)
Symbol
Parameter
Conditions
Minimum
Typical
Maximum
Units
VCCIO
Output supply voltage
3.0
3.3
3.6
V
VTT /VREF
Termination and input
reference voltage
1.35
1.5
1.65
V
VIH
High-level input voltage
VREF + 0.2
V
VIL
Low-level input voltage
VREF – 0.2
V
Table 6–29. 1.5-V HSTL Class I Specifications (Part 2 of 2)
Symbol
Parameter
Conditions
Minimum
Typical
Maximum
Units
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PDF描述
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