參數資料
型號： EP1SGX40DF1020C7N
廠商： Altera
文件頁數： 36/1456頁
文件大?。?/td> 0K
描述： IC STRATIX GX FPGA 40K 1020-FBGA
產品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 12
系列： Stratix® GX
LAB/CLB數： 4125
邏輯元件/單元數： 41250
RAM 位總計： 3423744
輸入/輸出數： 624
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1020-BBGA
供應商設備封裝： 1020-FBGA（33x33）
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Altera Corporation
4–27
February 2005
Stratix GX Device Handbook, Volume 1
Stratix GX Architecture
The memory address depths and output widths can be configured as
4,096 × 1, 2,048 × 2, 1,024 × 4, 512 × 8 (or 512 × 9 bits), 256 × 16 (or
256 × 18 bits), and 128 × 32 (or 128 × 36 bits). The 128 × 32- or 36-bit
configuration is not available in the true dual-port mode. Mixed-width
configurations are also possible, allowing different read and write
widths. Tables 4–4 and 4–5 summarize the possible M4K RAM block
configurations.
When the M4K RAM block is configured as a shift register block, you can
create a shift register up to 4,608 bits (w × m × n).
Table 4–4. M4K RAM Block Configurations (Simple Dual-Port)
Read Port
Write Port
4K 1
2K × 2
1K
° 4 512 ° 8 256 ° 16 128 ° 32 512 ° 9 256 ° 18 128 ° 36
4K
× 1
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2K
× 2
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1K
× 4
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512
× 8
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256
× 16
v
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128
× 32
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512
× 9
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256
× 18
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v
128
× 36
vv
v
Table 4–5. M4K RAM Block Configurations (True Dual-Port)
Port A
Port B
4K × 1
2K × 2
1K × 4
512 × 8
256 × 16
512 × 9
256 × 18
4K
× 1
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2K
× 2
vvvvv
1K
× 4
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512
× 8
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256
× 16
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512
× 9
vv
256
× 18
vv
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PDF描述
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