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參數(shù)資料
| 型號(hào)： | ELANSC300-33VC |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| 中文描述： | 32-BIT, 33 MHz, MICROCONTROLLER, PQFP208 |
| 封裝： | TQFP-208 |
| 文件頁數(shù)： | 118/139頁 |
| 文件大小： | 1388K |
| 代理商： | ELANSC300-33VC |
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118
élanSC300 Microcontroller Data Sheet
P R E L I M I N A R Y
Notes:
1. WAIT_AB asserted for longer than 10
μ
s may cause a DRAM RAS
Low (max) to be violated if this “extended” PCMCIA cycle
occurs during a DRAM page hit. (See the t
RASC
max parameter for a particular DRAM.) The RAS active timer (10
μ
s) will not
force RAS inactive while the "extended" PCMCIA cycle is occurring.
2. PCMCIA specifies 60 ns minimum for data setup to I/O write active.
These timings are based on default device settings and required initial programming. These timings may be modified via the Wait
State Control and Command Delay Registers. (See the élan
TM
SC300 Microcontroller Programmer’s Reference Manual,
order
#18470.)
Table 63.
PCMCIA I/O Write Cycle (See Figure 46)
Symbol
Parameter Description
Notes
Preliminary
Units
Min
Max
t1
t2
t3a
t3b
t4a
t4b
t5
t6a
t6b
t7
t8a
t8b
t9
t10
t11
t12
t13
t14a
t14b
t15
t16
t17
Data setup before IOW active
Data hold following IOW
IOW width time (8 bit)
IOW width time (16 bit)
Address setup before IOW (8 bit)
Address setup before IOW (16 bit)
Address hold following IOW
MCEL setup before IOW (8 bit)
MCEL setup before IOW (16 bit)
MCE hold after IOW
REG setup before IOW (8 bit)
REG setup before IOW (16 bit)
REG hold after IOW
IOIS16 delay falling from Address
IOIS16 delay rising from Address
WAIT_AB delay falling from IOW
WAIT_AB pulse width time
DBUFOE setup before IOW (8 bit)
DBUFOE setup before IOW (16 bit)
DBUFOE hold after IOW
MCEH delay from IOIS16 active
IOW inactive from WAIT_AB inactive
2
25
50
440
165
175
165
50
215
160
50
230
170
50
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
35
35
35
1
12,000
230
165
50
50
100
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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