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參數(shù)資料
| 型號： | ELANSC300-25KC |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| 中文描述： | 32-BIT, 25 MHz, MICROCONTROLLER, PQFP208 |
| 封裝： | SHRINK, PLASTIC, QFP-208 |
| 文件頁數(shù)： | 136/139頁 |
| 文件大?。?/td> | 1388K |
| 代理商： | ELANSC300-25KC |
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136
élanSC300 Microcontroller Data Sheet
P R E L I M I N A R Y
Notes:
The appropriate timings above are valid for the Bidirectional Parallel Port mode also. Timings t13 and t14 are also valid for the
Unidirectional Parallel Port mode. (PPDCS is PPWDE in Unidirectional mode.)
Table 72.
EPP Data Register Write Cycle (See Figure 55)
Symbol
Parameter Description
Max
Min
Unit
t0
t1
t2
t3
t4
t5
t6
t7
t8
t9
t10
t11
t12
t13
t14
t15
t16
AFDT delay from IOW active
AFDT delay from PPDCS active
AFDT delay from PPOEN active
AFDT active pulse width (no wait states added)
AFDT High to Low recovery
AFDT Low to STRB Low
STRB delay from PPDCS active
STRB delay from PPOEN active
AFDT High to STRB High delay
STRB Low to data valid delay
STRB High to data valid hold
PPOEN delay from IOW active
PPOEN delay from IOW inactive
PPDCS delay from IOW active
PPDCS delay from IOW inactive
AFDT hold from BUSY High
BUSY Low delay from AFDT active
8.4
1.8
1.0
450
1000
–0.2
1.6
0.8
–2.4
3.7
4.9
1.1
0.8
448
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
0.9
0.6
–1.4
4.0
7.4
1.1
6.6
4.3
129
139
307
t3
t1
t2
t0
t15
t4
t5
t7
t8
t9
t10
t16
t11
t12
t13
t14
Valid Data
AFDT
STRB
D7–D0
BUSY
PPOEN
PPDCS
IOW
IOR
t6
Figure 55.
EPP Data Register Write Cycle
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PDF描述 |
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