Symphony DSP56720/DSP56721 Multi-Core Audio Processors, Rev. 5 Freescale Semicon" />
參數(shù)資料
型號: DSPB56721CAG
廠商: Freescale Semiconductor
文件頁數(shù): 40/54頁
文件大?。?/td> 0K
描述: DSP 24BIT AUD 200MHZ 144-LQFP
標準包裝: 60
系列: DSP56K/Symphony
類型: 音頻處理器
接口: 主機接口,I²C,SAI,SPI
時鐘速率: 200MHz
非易失內存: 外部
芯片上RAM: 744kB
電壓 - 輸入/輸出: 3.30V
電壓 - 核心: 1.00V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 144-LQFP
供應商設備封裝: 144-LQFP(20x20)
包裝: 托盤
Symphony DSP56720/DSP56721 Multi-Core Audio Processors, Rev. 5
Freescale Semiconductor
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Table 18. EMC Timing Parameters (EMC PLL Bypassed; LRCC[CLKDIV] = 4)
Parameter
Symbol
Min
Max
Unit
LCLK cycle time
Tclk
20
ns
Input setup to LCLK (except LGTA/LUPWAIT)
Tin_s
8—
ns
Input hold from LCLK (except LGTA/LUPWAIT)1
Tin_h
-1
ns
LGTA valid time
Tgta
22
ns
LUPWAIT valid time
Tupwait
22
ns
LALE negedge to LAD (address phase) invalid (address latch hold time)
Tale_h
4—
ns
LALE valid time
Tale
14
ns
Output setup from LCLK (except LAD[23:0] and LALE)
Tout_s
9—
ns
Output hold from LCLK (except LAD[23:0] and LALE)
Tout_h
8—
ns
LAD[23:0] output setup from LCLK
Tad_s
8—
ns
LAD[23:0] output hold from LCLK
Tad_h
7—
ns
LCLK to output high impedance for LAD[23:0]
Tad_z
—8.1
ns
Notes:
1. A negative hold time means that the signal could be invalid before the LCLK rising edge.
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PDF描述
TAJY687M004RNJ CAP TANT 680UF 4V 20% 2917
MC78M08CDTRK IC REG LDO 8V .5A DPAK-3
ESM10DRUH CONN EDGECARD 20POS DIP .156 SLD
ACB65DHLD CONN EDGECARD 130PS .050 DIP SLD
ESM08DRTN CONN EDGECARD 16POS DIP .156 SLD
相關代理商/技術參數(shù)
參數(shù)描述
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DSPB56725CAF 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC PB FREE DSPB56724 AP RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
DSPB720DB1E 功能描述:子卡和OEM板 B VERSION 720 DAUGHTER C RoHS:否 制造商:BeagleBoard by CircuitCo 產(chǎn)品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit