Serial Host Interface (SHI) I2C Protocol Timing DSP56371 Data Sheet, Rev. 4.1 Fr" />
參數(shù)資料
型號(hào)： DSPB56371AF150
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 42/68頁(yè)
文件大小： 0K
描述： IC DSP 24BIT 150MHZ 80-LQFP
標(biāo)準(zhǔn)包裝： 90
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機(jī)接口，I²C，SAI，SPI
時(shí)鐘速率： 150MHz
非易失內(nèi)存： ROM（384 kB）
芯片上RAM： 264kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.25V
工作溫度： -40°C ~ 115°C
安裝類型： 表面貼裝
封裝/外殼： 80-LQFP
供應(yīng)商設(shè)備封裝： 80-LQFP（14x14）
包裝： 托盤
Serial Host Interface (SHI) I2C Protocol Timing
DSP56371 Data Sheet, Rev. 4.1
Freescale Semiconductor
47
13.1 Programming the Serial Clock
The programmed serial clock cycle, TI2CCP, is specified by the value of the HDM[7:0] and HRS bits of the
HCKR (SHI clock control register).
The expression for TI2CCP is
TI2CCP = [TC × 2 × (HDM[7:0] + 1) × (7 × (1 – HRS) + 1)]
Eqn. 1
where
— HRS is the pre-scaler rate select bit. When HRS is cleared, the fixed
divide-by-eight pre-scaler is operational. When HRS is set, the pre-scaler is bypassed.
— HDM[7:0] are the divider modulus select bits. A divide ratio from 1 to 256 (HDM[7:0] = $00
to $FF) may be selected.
52
Data set-up time
TSU;DAT
250
—
100
—
ns
53
Data hold time
THD;DAT
0.0
—
0.0
0.9
s
54
DSP clock frequency
FOSC
10.6
—
28.5
—
MHz
55
SCL low to data out valid
TVD;DAT
—3.4
—0.9
s
56
Stop condition setup time
TSU;STO
4.0
—
0.6
—
s
57
HREQ in deassertion to last SCL edge (HREQ in
set-up time)
tSU;RQI
0.0
—
0.0
—
ns
58
First SCL sampling edge to HREQ output
deassertion
TNG;RQO
4
× T
C + 30
—
52
—
52
ns
59
Last SCL edge to HREQ output not deasserted
TAS;RQO
2
× T
C + 30
52
—
52
—
ns
60
HREQ in assertion to first SCL edge
TAS;RQI
0.5
× T
I2CCP
-0.5
× T
C - 21
4327
—
927
—
ns
61
First SCL edge to HREQ in not asserted
(HREQ in hold time.)
tHO;RQI
0.0
—
0.0
—
ns
Note:
1. VCORE_VDD = 1.2 5 ± 0.05 V; TJ = –40°C to 115°C for 150 MHz; TJ = 0°C to 100°C for 181 MHz; CL = 50 pF
2. Pull-up resistor: R P (min) = 1.5 kOhm
3. Capacitive load: C b (max) = 50 pF
4. All times assume noise free inputs
5. All times assume internal clock frequency of 180MHz
Table 21. SHI I2C Protocol Timing (continued)
Standard I2C*
No.
Characteristics1
Symbol/
Expression
Standard
Fast-Mode
Unit
Min
Max
Min
Max
相關(guān)PDF資料
PDF描述
RMM36DRKF-S13 CONN EDGECARD 72POS .156 EXTEND
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VI-B6R-CY-F3 CONVERTER MOD DC/DC 7.5V 50W
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ABB65DHLN CONN EDGECARD 130PS .050 DIP SLD
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參數(shù)描述
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DSPB56374AEC 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC 52 LQFP AUTOMOTIVE RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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