Rev: 063008 189 of 375 10.4 Arbiter Registers" />
參數(shù)資料
型號(hào)： DS33X162DK
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 100/375頁(yè)
文件大?。?/td> 0K
描述： KIT DEMO FOR DS33X162+
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 1
主要目的： 接口，以太網(wǎng)
已用 IC / 零件： DS33X162+
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Rev: 063008
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10.4 Arbiter Registers
The Arbiter manages the transport between the Ethernet port and the Serial Interface. It is responsible for queuing
and dequeuing data to an external SDRAM. The arbiter handles requests from the HDLC and MAC to transfer data
to/from the SDRAM.
10.4.1 Arbiter Register Bit Descriptions
Register Name:
AR.LQ1SA
Register Description:
LAN Queue 1 Start Address
Register Address:
100h
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
101h:
-
LQ1QPR
LQ1SA-10
LQ1SA-9
Default
0
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
100h:
LQ1SA-8
LQ1SA-7
LQ1SA-6
LQ1SA-5
LQ1SA-4
LQ1SA-3
LQ1SA-2
LQ1SA-1
Default
0
Bit 10: LAN Queue 1 Queue Pointer Reset
0 = No reset of the Queue Pointers (the user may be re-configuring to the same value)
1 = Momentary Reset of Queue Pointers (user is not required to change value to “0” to conclude reset)
Bits 0-9: LAN Queue 1 Start Address [10-1] This register specifies the Start Address for the LAN Queue 1. The
value specifies the most significant 10 bits of the SDRAM absolute address.
Register Name:
AR.LQ2SA
Register Description:
LAN Queue 2 Start Address
Register Address:
102h
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
103h:
-
LQ2QPR
LQ2SA-10
LQ2SA-9
Default
0
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
102h:
LQ2SA-8
LQ2SA-7
LQ2SA-6
LQ2SA-5
LQ2SA-4
LQ2SA-3
LQ2SA-2
LQ2SA-1
Default
0
Bit 10: LAN Queue 2 Queue Pointer Reset.
0 = No reset of the Queue Pointers (the user may be re-configuring to the same value)
1 = Momentary Reset of Queue Pointers (user is not required to change value to “0” to conclude reset)
Bits 0-9: LAN Queue 2 Start Address [10-1] This register specifies the Start Address for the LAN Queue 2. The
value specifies the most significant 10 bits of the SDRAM absolute address.
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