參數(shù)資料
型號: DS3252+
廠商: Maxim Integrated Products
文件頁數(shù): 48/71頁
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描述: IC LIU DS3/E3/STS-1 144-CSBGA
產(chǎn)品培訓(xùn)模塊: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝: 160
類型: 線路接口裝置(LIU)
驅(qū)動器/接收器數(shù): 2/2
規(guī)程: IEEE 1149.1
電源電壓: 3.135 V ~ 3.465 V
安裝類型: 表面貼裝
封裝/外殼: 144-BGA,CSPBGA
供應(yīng)商設(shè)備封裝: 144-TECSBGA(13x13)
包裝: 托盤
DS3251/DS3252/DS3253/DS3254
52 of 71
Figure 17-4. Parallel CPU Interface Timing Diagram (Multiplexed)
ADDRESS
VALID
DATA VALID
A[5:0]
D[7:0]
WR
CS
RD
t2
t3
t4
t5
t10
ALE
t11
t12
t13
t14
NOTE: t14 STARTS ON THE OCCURRENCE OF EITHER THE RISING EDGE OF ALE OR A VALID ADDRESS, WHICHEVER OCCURS LAST.
NOTE: TO AVOID BUS CONTENTION, STOP DRIVING A[5:0] BEFORE
RD GOES LOW.
INTEL READ CYCLE
D[7:0]
RD
CS
WR
t2
t6
t4
t7
t8
t10
ADDRESS
VALID
A[5:0]
ALE
t11
t12
t13
t14
NOTE: t14 STARTS ON THE OCCURRENCE OF EITHER THE RISING EDGE OF ALE OR A VALID ADDRESS, WHICHEVER OCCURS LAST.
INTEL WRITE CYCLE
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PDF描述
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參數(shù)描述
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