參數(shù)資料
型號： DS3184+
廠商： Maxim Integrated Products
文件頁數(shù)： 46/400頁
文件大?。?/td> 0K
描述： IC PACKET PHY W/LIU 400-CSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 40
類型： 調(diào)幀器
應(yīng)用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 管件
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DS3181/DS3182/DS3183/DS3184
14
1 BLOCK DIAGRAMS
Figure 1-1 shows the external components required at each LIU interface for proper operation. Figure 1-2 shows
the functional block diagram of one channel ATM/Packet PHY.
Figure 1-1. LIU External Connections for a DS3/E3/STS-1 Port of a DS318x Device
1:2ct
Transmit
Receive
TXP
TXN
RXP
RXN
0.01uF
3.3V
Power
Plane
Ground
Plane
VDD
Each T3/E3 LIU
f
0.1uF
1uF
330
(1%)
330
(1%)
0.01uF
0.1uF
1uF
0.01uF
0.1uF
1uF
VDD
VSS
Figure 1-2. DS318x Functional Block Diagram
T
P
O
H
SO
Fn
/T
SO
FO
n/
TD
E
N
n\
TF
O
H
E
N
O
n
RLCLKn
RXPn
RXNn
TPOSn/
TDATn
TNEGn/
TOHMOn/
TLCLKn
DS3/E3
Transmit
LIU
IEEE P1149.1
JTAG Test
Access Port
D
[15:
0]
A[
10
:1
]
AL
E
CS
RD
/DS
WR
/R/
W
Microprocessor
Interface
JT
D
O
JT
CL
K
JT
M
S
JT
DI
JT
RS
T
HDLC
FEAC
TXPn
TXNn
LL
B
DL
B
DS3 / E3
Transmit
Formatter
DS3 / E3
Receive
Framer
Trail
Trace
Buffer
Tx Cell
Processor
Tx
FIFO
Syste
m
In
ter
face
Rx Cell
Processor
Rx
FIFO
RO
Hn
RO
HC
LKn
RO
HSO
F
n
TOH
n
TO
H
C
L
K
n
TO
H
S
O
F
n
TC
LK
In
Tx Packet
Processor
RPO
H
n/
RSE
R
n
RPOH
CL
K
n/
RCL
K
O
n/
R
P
OH
S
O
Fn/
R
SOFOn/
RDE
N
n
/RF
OH
E
N
O
n
TSCLK
TADR[4:0]
TDATA[31:0]
TPRTY
TEN
TDXA[4:2]
TSOX
TEOP
TSPA
TSX
TMOD[1:0]
TERR
RSCLK
RADR[4:0]
RDATA[31:0]
RPRTY
REN
RDXA[1]/RPXA
RDXA[4:2]
RSOX
REOP
RVAL
RMOD[1:0]
RERR
SL
B
Rx Packet
Processor
DS3/E3
Receive
LIU
TAIS
TUA1
TX FRAC/
PLCP
RX FRAC/
PLCP
T
O
HENn
Clock Rate
Adapter
TX BERT
RX BERT
CL
K
A
CL
KB
CL
K
C
RF
OH
E
N
In
/
MOD
E
IN
T
G
P
IO
[8
:1
]
WI
DT
H
RD
Y
T
P
O
HCL
K
N
/
TCL
K
On/
T
GC
LK
n
PL
B
AL
B
TOH
M
In
/T
SO
F
In
UA1
GEN
TP
O
H
n/
TF
O
H
n/
T
S
E
R
n
TPO
H
E
N
n/
T
F
OH
EN
In
/
TPD
E
N
In
TP
D
E
N
O
n
TP
D
A
Tn
RDATn
RPOSn/
RNEGn/
RLCVn/
ROHMIn
R
P
DENIn
RS
T
RP
D
A
T
n
RGC
L
Kn
A[
0]
/B
S
W
AP
TDXA[1]/TPXA
/RSX
B3ZS/
HDB3
Encoder
B3ZS/
HDB3
Decoder
n = port # (1-4)
DS318x
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PDF描述
MAX4507CWN IC SIGNAL LINE PROTECTOR 18-SOIC
MAX4507CAP IC SIGNAL LINE PROTECTOR 20-SSOP
LFXP20C-4F484I IC FPGA 19.7KLUTS 340I/O 484-BGA
MAX4505EUK-T IC SIGNAL LINE PROTECTOR SOT23-5
LFXP20E-4FN484I IC FPGA 19.7KLUTS 484FPBGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
DS3184+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3184DK 功能描述:網(wǎng)絡(luò)開發(fā)工具 RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
DS3184N 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3184N+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS318PIN 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Industrial Control IC
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