參數(shù)資料
型號： DS3172N
英文描述： Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers
中文描述： 單/雙/三/四DS3/E3單芯片收發(fā)器
文件頁數(shù)： 224/232頁
文件大?。?/td> 2133K
代理商： DS3172N
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DS3171/DS3172/DS3173/DS3174
224 of 232
18.5 Micro Interface AC Characteristics
The AC characteristics for the external bus interface. This table references
Figure 18-7
and
Figure 18-8
.
Table 18-5. Micro Interface Timing
(V
DD
= 3.3 ±5%, Tj = -40°C to +125°C.)
SIGNAL
NAME(S)
A[10:0]
ALE
A[10:0]
A[10:0]
ALE
A[N:0], ALE
CS
, R/
W
D[15:0]
RD
,
WR
,
DS
RD
,
WR
,
DS
SYMBOL
DESCRIPTION
MIN
TYP MAX UNITS NOTES
t1a
t1b
t2
t3
t4
t5
t6
t8
t9a
t9b
Setup Time to
RD
,
WR
,
DS
Active
Setup Time to
RD
,
WR
,
DS
Active
Setup Time to ALE Inactive
Hold Time from ALE Inactive
Pulse Width
Hold Time from
RD
,
WR
,
DS
Inactive
Setup Time to
RD
,
WR
Active
Output Delay Time from
RD
,
DS
Active
Pulse Width if not using RDY Handshake
Delay from RDY
Output Deassert Delay Time from
RD
,
DS
Inactive
Hold Time from
RD
,
WR
,
DS
Inactive
Input Setup Time to
WR
,
DS
Inactive
Input Hold Time from
WR
,
DS
Inactive
Delay Time from
RD
,
WR
,
DS
Active
Delay Time from
RD
,
WR
,
DS
Inactive
Enable Delay Time from
CS
Active
Disable Delay Time from
CS
Inactive
Ending High Pulse Width
Setup Time to
DS
Active
Hold Time to
DS
Inactive
10
10
2
2
5
0
0
35
15
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
1
1, 2
1, 2
1, 2
1, 2
1
1
1
1, 4
1
30
D[15:0]
t10
2
10
ns
1, 3
CS
, R/
W
D[15:0]
D[15:0]
RDY
RDY
RDY
RDY
RDY
R/
W
R/
W
t12
t13
t14
t15
t16
t17
t18
t19
t20
t21
0
10
5
5
0
1
2
2
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
1
1
1
1
1
1
1
1
1
1
12
10
Notes
:
1. The input/output timing reference level for all signals is V
DD
/2. Transition time (80/20%)on
RD
,
WR
and
CS
inputs is 5 ns max.
2. Multiplexed mode timing only.
3. D[15:0] output valid until not driven.
4. Timing required if not using RDY handshake.
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