參數(shù)資料
型號： DS26519G
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 數(shù)字傳輸電路
英文描述： 16-Port T1/E1/J1 Transceiver
中文描述： DATACOM, FRAMER, PBGA484
封裝： 23 X 23 MM, 1 MM PITCH, HSBGA-484
文件頁數(shù)： 25/310頁
文件大?。?/td> 1881K
代理商： DS26519G
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DS26519 16-Port T1/E1/J1 Transceiver
25 of 310
NAME
PIN
TYPE
FUNCTION
RECEIVE FRAMER
RSER1
RSER2
RSER3
RSER4
RSER5
RSER6
RSER7
RSER8
RSER9
RSER10
RSER11
RSER12
RSER13
RSER14
RSER15
RSER16
RCLK1
RCLK2
RCLK3
RCLK4
RCLK5
RCLK6
RCLK7
RCLK8
RCLK9
RCLK10
RCLK11
RCLK12
RCLK13
RCLK14
RCLK15
RCLK16
RSYSCLK1
RSYSCLK2
RSYSCLK3
RSYSCLK4
RSYSCLK5
RSYSCLK6
RSYSCLK7
RSYSCLK8
RSYSCLK9
RSYSCLK10
RSYSCLK11
RSYSCLK12
RSYSCLK13
RSYSCLK14
RSYSCLK15
RSYSCLK16
D12
E12
J5
AA4
Y10
AA10
B18
T20
L17
L16
B1
K7
J4
P7
H13
M16
J9
H7
J8
H6
T15
U19
V20
W20
D3
C2
H3
G3
T17
R15
T18
N15
U18
G9
J6
W7
AB7
AB10
C19
AA22
G6
P18
F2
AB2
P8
R7
G15
T19
Output
Received Serial Data 1 to 16.
Received NRZ serial data. Updated on rising
edges of RCLKn when the receive-side elastic store is disabled. Updated on the
rising edges of RSYSCLKn when the receive-side elastic store is enabled.
When IBO mode is used, the RSERn pins can output data for multiple framers.
The RSERn data is synchronous to RSYSCLKn. See Section
9.8.2
and
Table
9-6
.
Ouput
Receive Clock.
A 1.544MHz (T1) or 2.048MHz (E1) clock that is used to clock
data through the receive-side framer. This clock is recovered from the signal at
RTIPn and RRINGn. RSERn data is output on the rising edge of RCLKn. RCLKn
is used to output RSERn when the elastic store is not enabled or IBO is not used.
When the elastic store is enabled or IBO is used, the RSERn is clocked by
RSYSCLKn.
Input
Receive System Clock 1 to 16.
1.544MHz, 2.048MHz, 4.096MHz, 8.192MHz, or
16.384MHz receive backplane clock. Only used when the receive-side elastic
store function is enabled. Should be tied low in applications that do not use the
receive-side elastic store. Multiple of 2.048MHz is expected when the IBO mode
is used.
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PDF描述
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