參數(shù)資料
型號： DS21Q43AT
廠商： DALLAS SEMICONDUCTOR
元件分類： Digital Transmission Controller
英文描述： DATACOM, FRAMER, PQFP128
封裝： TQFP-128
文件頁數(shù)： 17/60頁
文件大小： 748K
代理商： DS21Q43AT
DS21Q43A
24 of 60
SSR: SYNCHRONIZER STATUS REGISTER (Address=1E Hex)
(MSB)
(LSB)
CSC5
CSC4
CSC3
CSC2
CSC0
FASSA
CASSA
CRC4SA
SYMBOL
POSITION
NAME AND DESCRIPTION
CSC5
SSR.7
CRC4 Sync Counter Bit 5. MSB of the 6-bit counter.
CSC4
SSR.6
CRC4 Sync Counter Bit 4.
CSC3
SSR.5
CRC4 Sync Counter Bit 3.
CSC2
SSR.4
CRC4 Sync Counter Bit 2.
CSC0
SSR.3
CRC4 Sync Counter Bit 0. LSB of the 6-bit counter. The next
to LSB is not accessible.
FASSA
SSR.2
FAS Sync Active. Set while the synchronizer is searching for
alignment at the FAS level.
CASSA
SSR.1
CAS MF Sync Active. Set while the synchronizer is searching
for the CAS MF alignment word.
CRC4SA
SSR.0
CRC4 MF Sync Active. Set while the synchronizer is searching
for the CRC4 MF alignment word.
CRC4 SYNC COUNTER
The CRC4 Sync Counter increments each time the 8 ms CRC4 multiframe search times out. The counter
is cleared when the DS21Q43A has successfully obtained synchronization at the CRC4 level. The counter
can also be cleared by disabling the CRC4 mode (CCR1.0=0). This counter is useful for determining the
amount of time the DS21Q43A has been searching for synchronization at the CRC4 level. Annex B of
ITU G.706 suggests that if synchronization at the CRC4 level cannot be obtained within 400 ms, then the
search should be abandoned and proper action taken. The CRC4 Sync Counter will rollover.
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PDF描述
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參數(shù)描述
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