參數(shù)資料
型號(hào)： DS21Q43AT
元件分類(lèi)： 通信及網(wǎng)絡(luò)
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁(yè)數(shù)： 52/60頁(yè)
文件大小： 748K
代理商： DS21Q43AT
DS21Q43A
52 of 60
Delay RSYSCLK to RMSYNC or
RSYNC
Delay RCLK to RLCLK
Delay RCLK to RLINK Valid
t
D4
t
D5
75
75
ns
ns
See Figures 12-4 to 12-6 for details.
NOTES:
1.
RSYSCLK=1.544 MHz.
2.
RSYSCLK=2.048 MHz.
3.
RSYNC in input mode.
RECEIVE SIDE AC TIMING
Figure 12-4
NOTES:
1.
RSYNC is in the output mode (RCR1.5=0).
2.
RLCLK will only pulse high during Sa bit locations as defined in RCR2; no relationship between
RLCLK and RLCLK and RFSYNC is implied.
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