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參數(shù)資料
| 型號： | DS2174Q+T&R |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 5/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC BERT ENHANCED 44-PLCC |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 500 |
| 功能： | 增強型位誤碼率測試器（EBERT） |
| 接口： | E1，J1，T1 |
| 電路數(shù)： | 1 |
| 電源電壓： | 3 V ~ 3.6 V |
| 電流 - 電源： | 50mA |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 供應商設備封裝： | 44-PLCC（16.59x16.59） |
| 包裝： | 帶卷 (TR) |
| 包括： | 錯誤計數(shù)器，樣式發(fā)生器和檢測器 |
DS2174
13 of 24
3.1 Mode Select
The DS2174 is configured to operate in bit, nibble, or byte mode by using the MODE1/MODE0 bits in
Control Register 2.
Table 3-A. Mode Select
MODE1
MODE0
OPERATION MODE
00
Bit
0
1
Nibble
10
Byte
1
Invalid
3.1.1 Error Insertion
The DS2174 inserts bit errors at a particular rate by setting the error insertion bits in Control Register 2
(Table 3-B). In addition, the device inserts errors on command by setting the SBE bit in Control Register
2. The bit that occurs after the rising edge of the SBE insert bit is inverted. In the case of the QRSS
pattern, this could result in a string of 0’s longer than 14 bits; the DS2174 delays the erred bit by 1 clock
cycle.
Data in the nibble and byte modes is presented 4 or 8 bits at a time. When in nibble or byte mode and
selecting 10-1 error rate, the device actually produces an error rate of 8-1. When in byte mode and
selecting an error rate of 10-2, the device produces an error rate of 8-2.
Table 3-B. Error Bit Insertion
EIR2
EIR1
EIR0
ERROR RATE
SERIAL
NIBBLE
BYTE
000
None
444
001
10-1
4
8-1
010
10-2
44
8-2
011
10-3
444
100
10-4
444
101
10-5
444
110
10-6
444
111
10-7
444
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