(VDD
參數(shù)資料
型號： DS2174Q+
廠商： Maxim Integrated Products
文件頁數(shù)： 16/24頁
文件大小： 0K
描述： IC BERT ENHANCED 44-PLCC
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 26
功能： 增強型位誤碼率測試器（EBERT）
接口： E1，J1，T1
電路數(shù)： 1
電源電壓： 3 V ~ 3.6 V
電流 - 電源： 50mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應商設備封裝： 44-PLCC（16.59x16.59）
包裝： 管件
包括： 錯誤計數(shù)器，樣式發(fā)生器和檢測器
DS2174
23 of 24
Figure 6-4. Receive Interface Timing
Table 6-D. RECEIVE DATA TIMING
(VDD = 3.0V to 3.6V, TA = 0°C to +70°C for DS2174Q; VDD = 3.0V to 3.6V, TA = -40°C to +85°C
for DS2174QN)
PARAMETER
SYMBOL
MIN
TYP
MAX UNITS NOTES
RCLK Clock Period (Nibble/Byte
Mode)
tCYC
12.5
ns
RCLK High Time (Nibble/Byte Mode)
tPWH
5.0
tCYC
ns
RCLK Low Time (Nibble/Byte Mode)
tPWL
5.0
tCYC
ns
RCLK Clock Period (Bit Mode)
tCYC
6.45
ns
1
RCLK High Time (Bit Mode)
tPWH
2.0
tCYC
ns
1
RCLK Low Time (Bit Mode)
tPWL
2.0
tCYC
ns
1
RCLK_EN Setup Time Before RCLK
tSU(1)
2.5
ns
RCLK_EN Hold Time After RCLK
tH(1)
2.5
ns
RDAT(7:0) Setup Time Before RCLK
tSU(2)
2.5
ns
RDAT(7:0) Hold Time After RCLK
tH(2)
2.5
ns
NOTES:
1) Guaranteed by design.
t
CYC
t
PWH
t
PWL
t
SU(2)
t
H(2)
t
SU(1)
t
H(1)
RCLK
RDAT
RCLK_EN
IGNORE
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