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參數(shù)資料
| 型號： | DRC-10520-493S |
| 廠商： | DATA DEVICE CORP |
| 元件分類： | 位置變換器 |
| 英文描述： | DIGITAL TO SYNCHRO OR RESOLVER, DMA32 |
| 封裝： | TRIPLE, DIP-32 |
| 文件頁數(shù)： | 4/9頁 |
| 文件大?。?/td> | 167K |
| 代理商： | DRC-10520-493S |
4
Data Device Corporation
www.ddc-web.com
DRC-10520
N-05/05-0
200 nS min.
TRANSPARENT
LATCHED
DATA 1-16 BITS
50 nS min.
100 nS min.
Data Changing
Data Stable
Data Changing
Data Stable
50 nS min.
100 nS min.
50 nS min.
100 nS min.
200 nS min.
LL
LM
LA
DATA
Bits (9-16)
Bits (1-8)
200 nS min.
LA, LM, LL
Transparent = Hi
Latched = Lo
FIGURE 2A. LL,LM,LA TIMING DIAGRAM (16 BIT)
FIGURE 2B. LL,LM,LA TIMING DIAGRAM (8 BIT)
The output is 6.8V rms line-to-line resolver format signal which
may be converted into a synchro format of 11.8V Iine-to-line with
the companion Scott-T transformer module available as DDC
P/N 29305.
DRIVING THE POWER AMPLIFIER WITH THE
REFERENCE
The high power amplifier stage can be driven by a standard ±15V
DC supply or with a high efficiency pulsating power supply
derived from the reference voltage source. A companion power
transformer DDC P/N 29306, designed to implement the pulsat-
ing power source for the DRC-10520, is also available (FIGURE
3). The DRC-10520 will not be damaged by sequencing order in
the ±15V, V
L supplies or the reference input.
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