參數資料
型號： CY7C43682
廠商： Cypress Semiconductor Corp.
英文描述： 16K x36 x2 Bidirectional Synchronous FIFO(16K x36 x2 雙向同步先進先出)
中文描述： 16K的x36 x2雙向同步FIFO（16K的x36 x2雙向同步先進先出）
文件頁數： 17/31頁
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代理商： CY7C43682
CY7C43622
CY7C43632/CY7C43642
CY7C43662/CY7C43682
17
PRELIMINARY
Note:
23. t
is the minimum time between a rising CLKB edge and a rising CLKA edge for IRA to transition HIGH in the next CLKA cycle. If the time between the
rising CLKB edge and rising CLKA edge is less than t
SKEW1
, then IRA may transition HIGH one CLKA cycle later than shown.
Switching Waveforms
(continued)
t
CLKH
t
CLKL
t
ENS
t
ENH
t
A
LOW
HIGH
HIGH
FIFO1 Full
LOW
HIGH
t
ENS
t
ENH
t
WFF
t
WFF
t
CLKH
t
CLKL
t
CLK
t
CLK
t
SKEW1[23]
t
DH
t
DS
t
ENH
t
ENS
Previous Word in FIFO1 Output Register
Next Word From FIFO1
To FIFO1
CLKB
CSB
W/RB
MBB
ENB
EFB/ORB
B
0
–
35
CLKA
FFA/IRA
CSA
W/RA
MBA
ENA
A
0
–
35
IRA Flag Timing and First Available Write when FIFO1 is Full (FWFT Mode)
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PDF描述
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