參數(shù)資料
型號： CY7C1018CV33-12VC
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： DRAM
英文描述： 128K x 8 Static RAM
中文描述： 128K X 8 STANDARD SRAM, 12 ns, PDSO32
封裝： 0.300 INCH, SOJ-32
文件頁數(shù)： 4/7頁
文件大?。?/td> 132K
代理商： CY7C1018CV33-12VC
CY7C1018CV33
Document #: 38-05131 Rev. *C
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Switching Waveforms
Read Cycle No. 1
[12, 13]
Read Cycle No. 2 (OE Controlled)
[13, 14]
Write Cycle No. 1 (CE Controlled)
[15, 16]
Notes:
12. Device is continuously selected. OE, CE = V
IL
.
13. WE is HIGH for Read cycle.
14. Address valid prior to or coincident with CE transition LOW.
15. Data I/O is high impedance if OE = V
.
16. If CE goes HIGH simultaneously with WE going HIGH, the output remains in a high-impedance state.
PREVIOUS DATA VALID
DATA VALID
t
RC
t
AA
t
OHA
ADDRESS
DATA OUT
50%
50%
DATA VALID
t
RC
t
ACE
t
DOE
t
LZOE
t
LZCE
t
PU
HIGH IMPEDANCE
t
HZOE
t
HZCE
t
PD
HIGH
OE
CE
ICC
ISB
IMPEDANCE
ADDRESS
DATA OUT
V
SUPPLY
CURRENT
t
WC
DATA VALID
t
AW
t
SA
t
PWE
t
HA
t
HD
t
SD
t
SCE
t
SCE
CE
ADDRESS
WE
DATA I/O
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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