參數(shù)資料
型號(hào)： CY62128ELL-55ZAXE
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： DRAM
英文描述： 1-Mbit (128K x 8) Static RAM
中文描述： 128K X 8 STANDARD SRAM, 55 ns, PDSO32
封裝： 8 X 13.40 MM, LEAD FREE, STSOP-32
文件頁(yè)數(shù)： 6/11頁(yè)
文件大?。?/td> 862K
代理商： CY62128ELL-55ZAXE
Document #: 38-05485 Rev. *E
Page 6 of 11
CY62128E MoBL
Switching Waveforms
Read Cycle 1
(Address Transition Controlled)
[16, 17]
Read Cycle No. 2
(OE Controlled)
[11, 17, 18]
Write Cycle No. 1
(WE Controlled)
[11, 15, 19, 20]
PREVIOUS DATA VALID
DATA VALID
t
RC
t
AA
t
OHA
ADDRESS
DATA OUT
50%
50%
DATA VALID
t
RC
t
ACE
t
DOE
t
LZOE
t
LZCE
t
PU
HIGH IMPEDANCE
t
HZOE
t
HZCE
t
PD
IMPEDANCE
I
CC
I
SB
HIGH
ADDRESS
CE
DATA OUT
V
CC
SUPPLY
CURRENT
OE
DATA VALID
t
HD
t
SD
t
PWE
t
SA
t
HA
t
AW
t
SCE
t
WC
t
HZOE
ADDRESS
CE
WE
DATA IO
OE
NOTE
21
Notes:
16.The device is continuously selected. OE, CE
1
= V
IL
, CE
2
= V
IH
.
17.WE is HIGH for read cycle.
18.Address valid before or similar to CE
1
transition LOW and CE
2
transition HIGH.
19.Data IO is high impedance if OE = V
.
20.If CE
goes HIGH or CE
goes LOW simultaneously with WE HIGH, the output remains in high impedance state.
21.During this period, the IOs are in output state and input signals must not be applied.
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