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參數(shù)資料
| 型號： | CY39200Z388-167MGC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | LOADABLE PLD, 8.5 ns, PBGA388 |
| 封裝： | BGA-388 |
| 文件頁數(shù)： | 29/57頁 |
| 文件大小： | 1166K |
| 代理商： | CY39200Z388-167MGC |
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PRELIMINARY
Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. **
Page 35 of 57
Switching Waveforms (continued)
Channel Memory DP SRAM Pipeline R/W Timing
An+1
An+2
Dn+1
tCHMCYC2
tCHMH
tCHMS
tCHMH
An
tCHMS
tCHMH
Delta38K-18
An+3
An-1
Dn+3
Dn-1
tCHMDV2
Dn
Dn+1
Dn+2
tCHMDV2
CLOCK
WRITE
OUTPUT
ADDRESS
DATA
ENABLE
INPUT
Dual-Port Asynchronous Address Match Busy Signal
ADDRESS A
An
An-1
An
An+1
ADDRESS
tCHMBA
Bn
ADDRESS B
Delta39K-19
MATCH
相關PDF資料 |
PDF描述 |
|---|---|
| CY39200Z484-167BBC | LOADABLE PLD, 8.5 ns, PBGA484 |
| CY39200Z676-167MBC | LOADABLE PLD, 8.5 ns, PBGA676 |
| CY39100V388B-125MGXC | LOADABLE PLD, 10 ns, PBGA388 |
| CY39100V388B-83MGXC | LOADABLE PLD, 15 ns, PBGA388 |
| CY39200V208-125NTXC | LOADABLE PLD, 10 ns, PQFP208 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| CY39200Z388-233MGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200Z388-233MGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200Z484-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200Z484-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200Z676-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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