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參數資料
| 型號： | CXD3048R |
| 廠商： | Sony Corporation |
| 元件分類： | 數字信號處理 |
| 英文描述： | CD Digital Signal Processor with Built-in Digital Servo + Shock-proof Memory Controller + Digital High & Bass Boost |
| 中文描述： | CD數字信號處理器，具有內置數字伺服防震內存控制器數字高 |
| 文件頁數： | 192/205頁 |
| 文件大?。?/td> | 1481K |
| 代理商： | CXD3048R |
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– 192 –
CXD3048R
1
0
0
0
SYG3 SYG2 SYG1 SYG0
FIFZB3 FIFZB2 FIFZB1 FIFZB0 FIFZA3 FIFZA2 FIFZA1 FIFZA0
D15
D14
D13
D12
D11
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
$3F8 (preset: $3F8800)
SYG3 to SYG0: These simultaneously set the focus drive, tracking drive and sled drive output gains. See
the $AF and $CX commands for the spindle drive output gain setting.
GAIN
0 (–
∞
dB)
0.125 (–18.1dB)
0.250 (–12.0dB)
0.375 (–8.5dB)
0.500 (–6.0dB)
0.625 (–4.1dB)
0.750 (–2.5dB)
0.875 (–1.2dB)
1.000 (0.0dB)
1.125 (+1.0dB)
1.250 (+1.9dB)
1.375 (+2.8dB)
1.500 (+3.5dB)
1.625 (+4.2dB)
1.750 (+4.9dB)
1.875 (+5.5dB)
: preset
FIFZB3 to FIFZB0:
This sets the slice level at which FZC changes from high to low.
FIFZA3 to FIFZA0:
This sets the slice level at which FZC changes from low to high.
The FIFZB3 to FIFZB0 and FIFZA3 to FIFZA0 setting values are valid only when $3A
FIFZC is "1".
Set so that the FIFZB3 to FIFZB0
≤
FIFZA3 to FIFZA0.
Hysteresis can be added to the slice level by setting FIFZB3 to FIFZB0 < FIFZA3 to FIFZA0.
FZC slice level =
×
0.5
×
V
DD
[V]
32
SYG3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
SYG1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
SYG2
SYG0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
FIFZB3 to FIFZB0 or FIFZA3 to FIFZA0 setting value
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PDF描述 |
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