參數(shù)資料
型號： CXD3048R
廠商： Sony Corporation
元件分類： 數(shù)字信號處理
英文描述： CD Digital Signal Processor with Built-in Digital Servo + Shock-proof Memory Controller + Digital High & Bass Boost
中文描述： CD數(shù)字信號處理器，具有內(nèi)置數(shù)字伺服防震內(nèi)存控制器數(shù)字高
文件頁數(shù)： 133/205頁
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代理商： CXD3048R
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– 133 –
CXD3048R
§4-8. CD-DSP Block Playback Speed
In the CXD3048R, the following playback modes can be selected through different combinations of the XTAI,
XTSL pins, double-speed command (DSPB), VCO1 selection command (VCOSEL1), VCO1 frequency division
commands (KSL3, KSL2) and command transfer rate selector (ASHS) in CLV-N or CLV-W mode.
1
2
3
4
5
6
7
XTAI
768Fs
768Fs
768Fs
768Fs
384Fs
384Fs
384Fs
Mode
XTSL
1
1
0
0
0
0
1
DSPB
0
1
0
1
0
1
1
ASHS
0
0
1
1
0
0
0
Playback speed
1
×
2
×
2
×
4
×
1
×
2
×
1
×
Error correction
2
C1: double; C2: quadruple
C1: double; C2: double
C1: double; C2: quadruple
C1: double; C2: double
C1: double; C2: quadruple
C1: double; C2: double
C1: double; C2: double
VCOSEL1
1
0/1
0/1
1
1
0/1
0/1
0/1
1
Actually, the optimal value should be used together with KSL3 and KSL2.
2
When $8 command ERC4 = 1, C2 is quadruple correction even when DSPB = 1.
The playback speed can be varied by setting VP0 to VP7 in CAV-W mode. See "[3] Description of Modes" for
details.
§4-9. Description of DAC Block and Shock-proof Memory Controller Block Circuits
The CXD3048R inputs data from the CD-DSP block to the DAC block via the shock-proof memory controller
block.
The data from the shock-proof memory controller block is output externally as bass-boosted data via the DBB
circuit.
When not using the DAC block, the data from the shock-proof memory controller block can be output directly to
the outside of the LSI.
Also, when not using the shock-proof memory controller, the data can be input directly from the CD-DSP block
to the DAC block.
The DAC block output format supports 16, 18 or 20 bits.
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