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參數(shù)資料
| 型號(hào)： | CXD2720Q-2 |
| 廠商： | Sony Corporation |
| 英文描述： | CAP 10UF 50V 20% TANT SMD-7343-43 TR-13 GOLD |
| 中文描述： | 單片杜比定向邏輯環(huán)繞聲解碼器 |
| 文件頁數(shù)： | 8/47頁 |
| 文件大小： | 531K |
| 代理商： | CXD2720Q-2 |
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– 8 –
CXD2720Q-2
Item
RVDT setup time relative to SCK rise
RVDT data hold time from SCK rise
SCK Low level width
SCK High level width
XLAT Low level width
XLAT High level width
SCK rise preceding time relative to XLAT rise
SCK rise wait time relative to XLAT rise
Delay time to REDY fall relative to XLAT rise.
Delay time to REDY fall relative to SCK rise
REDY fall preceding time relative to SCK rise
REDY rise preceding time relative to XLAT rise
REDY rise preceding time relative to SCK fall
XLAT fall wait time relative to SCK rise
XLAT fall delay time relative to REDY fall
Delay time from XLAT rise until TRDT data becomes active
Delay time from SCK rise until TRDT data becomes high-impedance
Delay time from SCK fall until TRDT data is verified
SCK rise wait time for next transmission
20
1
t
+ 20
1
t
+ 20
1
t
+ 20
1
t
+ 20
1
t
+ 20
20
3
t
+ 20
20
20
20
3
t
+ 20
20
2
t
+ 40
3
t
+ 50
4
t
+ 50
3
t
+ 80
3
t
+ 80
2
t
+ 70
t
DS
t
DH
t
SWL
t
SWH
t
LWL
t
LWH
t
SLP
t
LSD
t
LBD
t
SBD
t
BSP
t
RLP
t
RSDP
t
SLD
t
LDR
t
LDN
t
SDF
t
SDD
t
SS
Symbol
Min.
Max.
Note 1)
t
is the cycle of 1/2 the clock frequency applied to the XTLI pin. (384fs)
Note 2)
REDY and TRDT pins are the values for CL = 60pF.
Unit
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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