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參數資料
| 型號： | CXD2589Q |
| 廠商： | Sony Corporation |
| 元件分類： | 數字信號處理 |
| 英文描述： | CD Digital Signal Processor |
| 中文描述： | CD數字信號處理器 |
| 文件頁數： | 27/61頁 |
| 文件大?。?/td> | 794K |
| 代理商： | CXD2589Q |
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– 27 –
CXD2589Q
$DX commands
Command bit
Description
TB = 0
TB = 1
TP = 0
TP = 1
Bottom hold at a cycle of RFCK/32 in CLVS mode.
Bottom hold at a cycle of RFCK/16 in CLVS mode.
Peak hold at a cycle of RFCK/4 in CLVS mode.
Peak hold at a cycle of RFCK/2 in CLVS mode.
Command
D3
0
TB
TP
Gain
CLVS
VP7
VP6
VP5
VP4
VP3
VP2
VP1
VP0
D2
D1
D0
D3
D2
D1
D0
D3
D2
D1
D0
Data 1
Data 2
CLV CTRL
Data 3
See the $CX commands.
Command bit
Description
VP0 to 7 = F0 (H)
:
VP0 to 7 = E0 (H)
Playback at half (normal) speed
to
Playback at normal (double)
speed
The rotational velocity R of the spindle can be
expressed with the following equation.
R =
32
256 – n
R: Relative velocity at normal speed = 1
n: VP0 to 7 setting value
Note)
Values in parentheses are for when DSPB is 1.
Values when crystal is 16.9344MHz and XTSL is low or when crystal is 33.8688MHz and XTSL is high.
VP0 to 7 setting values are valid in CAV-W mode.
2
R
1.5
1
0.5
F0
E0
VP0 to 7 setting value [HEX]
DSPB = 1
DSPB = 0
Fig. 1-1
相關PDF資料 |
PDF描述 |
|---|---|
| CXD2598Q | CD Digital Signal Processor with Built-in Digital Servo and DAC(數字式CD信號處理器（內置數字式伺服系統(tǒng)和D/A轉換器）) |
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相關代理商/技術參數 |
參數描述 |
|---|---|
| CXD2597Q | 制造商:SONY 制造商全稱:Sony Corporation 功能描述:CD Digital Signal Processor with Built-in Digital Servo and DAC |
| CXD2598 | 制造商:SONY 制造商全稱:Sony Corporation 功能描述:CD Digital Signal Processor with Built-in Digital Servo and DAC |
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