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參數(shù)資料
| 型號： | C8051F547-IM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 125/274頁 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU 8K FLASH 24-QFN |
| 應用說明： | LIN Bootloader AppNote |
| 產品培訓模塊： | Serial Communication Overview |
| 標準包裝： | 91 |
| 系列： | C8051F54x |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 50MHz |
| 連通性： | SMBus（2 線/I²C），SPI，UART/USART |
| 外圍設備： | POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 18 |
| 程序存儲器容量： | 8KB（8K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.25 V |
| 數(shù)據轉換器： | A/D 18x12b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 24-WFQFN 裸露焊盤 |
| 包裝： | 管件 |
| 配用： | 336-1672-ND - BOARD PROTOTYPE W/C8051F540 336-1669-ND - KIT DEVELOPMENT FOR C8051F540 |
| 其它名稱： | 336-1682-5 |
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C8051F54x
210
Rev. 1.1
SFR Address = 0x98; Bit-Addressable; SFR Page = 0x00
SFR Definition 21.1. SCON0: Serial Port 0 Control
Bit
7
6
5
4
3
2
1
0
Name
OVR0
PERR0
THRE0
REN0
TBX0
RBX0
TI0
RI0
Type
R/W
R
R/W
Reset
0
1
0
Bit
Name
Function
7
OVR0
Receive FIFO Overrun Flag.
0: Receive FIFO Overrun has not occurred
1: Receive FIFO Overrun has occurred; A received character has been discarded due
to a full FIFO.
6
PERR0
Parity Error Flag.
When parity is enabled, this bit indicates that a parity error has occurred. It is set to 1
when the parity of the oldest byte in the FIFO does not match the selected Parity Type.
0: Parity error has not occurred
1: Parity error has occurred.
This bit must be cleared by software.
5
THRE0
Transmit Holding Register Empty Flag.
0: Transmit Holding Register not Empty—do not write to SBUF0.
1: Transmit Holding Register Empty—it is safe to write to SBUF0.
4
REN0
Receive Enable.
This bit enables/disables the UART receiver. When disabled, bytes can still be read
from the receive FIFO.
0: UART1 reception disabled.
1: UART1 reception enabled.
3
TBX0
Extra Transmission Bit.
The logic level of this bit will be assigned to the extra transmission bit when XBE0 is set
to 1. This bit is not used when Parity is enabled.
2
RBX0
Extra Receive Bit.
RBX0 is assigned the value of the extra bit when XBE1 is set to 1. If XBE1 is cleared to
0, RBX1 will be assigned the logic level of the first stop bit. This bit is not valid when
Parity is enabled.
1
TI0
Transmit Interrupt Flag.
Set to a 1 by hardware after data has been transmitted, at the beginning of the STOP
bit. When the UART0 interrupt is enabled, setting this bit causes the CPU to vector to
the UART0 interrupt service routine. This bit must be cleared manually by software.
0
RI0
Receive Interrupt Flag.
Set to 1 by hardware when a byte of data has been received by UART0 (set at the
STOP bit sampling time). When the UART0 interrupt is enabled, setting this bit to 1
causes the CPU to vector to the UART0 interrupt service routine. This bit must be
cleared manually by soft-ware. Note that RI0 will remain set to ‘1’ as long as there is
data still in the UART FIFO. After the last byte has been shifted from the FIFO to
SBUF0, RI0 can be cleared.
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參數(shù)描述 |
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| C8051F550-IM | 功能描述:8位微控制器 -MCU 50 MIPS 32 kB 2 kB CAN2 LIN2.1 SPI UART RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051F550-IMR | 功能描述:8位微控制器 -MCU 50 MIPS 32 kB 2 kB CAN2.0 LIN 2.1 SPI RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051F551-IM | 功能描述:8位微控制器 -MCU 50 MIPS 32 kB 2 kB CAN2 SPI UART RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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