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參數(shù)資料
| 型號： | C8051F310-GQ |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 8/16 kB ISP Flash MCU Family |
| 中文描述： | 8 / 16 kB的ISP閃存微控制器系列 |
| 文件頁數(shù)： | 72/310頁 |
| 文件大?。?/td> | 2478K |
| 代理商： | C8051F310-GQ |
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Information
C8051F060/1/2/3
DVANCD
The Data Address Pointer Registers (DMA0DSH and DMA0DSL) contain the 16-bit XRAM address location where
the DMA interface will write data. When the DMA is initially enabled, the DMA Data Address Pointer Registers are
initialized to the values contained in the DMA Data Address Beginning Registers (DMA0DAH and DMA0DAL).
The Data Address Pointer Registers are automatically incremented by 2 or 4 after each data write by the DMA inter-
face.
6.2.
DMA0 Instruction Format
DMA instructions can request single-ended data from both ADC0 and ADC1, as well as the differential combination
of the two ADC inputs. The instruction format is identical to the DMA0IDT register, shown in Figure 6.7. Depending
on which bits are set to ‘1’ in the instruction word, either 2 or 4 bytes of data will be written to XRAM for each DMA
instruction cycle (excluding End-Of-Operation instructions). Table 6.1 details all of the valid DMA instructions.
Instructions not listed in the table are not valid DMA instructions, and should not be used. Note that the ADCs can be
independently controlled by the microcontroller when their outputs are not requested by the DMA.
6.3.
XRAM Addressing and Setup
The DMA Interface can be configured to access either on-chip or off-chip XRAM. Any writes to on-chip XRAM by
the DMA Control Logic occur when the processor core is not accessing the on-chip XRAM. This ensures that the
DMA will not interfere with processor instruction timing.
Off-chip XRAM access (only available on the C8051F060/2) is controlled by the DMA0HLT bit in DMA0CF (DMA
Configuration Register, Figure 6.5). The DMA will have full access to off-chip XRAM when this bit is ‘0’, and the
processor core will have full access to off-chip XRAM when this bit is ‘1’. The DMA0HLT bit should be controlled
in software when both the processor core and the DMA Interface require access to off-chip XRAM data space. Before
setting DMA0HLT to ‘1’, the software should check the DMA0XBY bit to ensure that the DMA is not currently
accessing off-chip XRAM. The processor core cannot access off-chip XRAM while DMA0HLT is ‘0’. The processor
will continue as though it was able to perform the desired memory access, but the data will not be written to or read
from off-chip XRAM. When the processor core is finished accessing off-chip XRAM, DMA0HLT should be set back
to ‘0’in software to return control to the DMA Interface. The DMA Control Logic will wait until DMA0HLT is ‘0’
before writing data to off-chip XRAM. If new data becomes available to the DMA Interface before the previous data
has been written, an overflow condition will occur, and the new data word may be lost.
Table 6.1. DMA0 Instruction Set
Instruction
Word
Description
First Data Written
to XRAM (2 bytes)
SecondDataWritten
to XRAM (2 bytes)
00000000b
End-Of-Operation
none
none
10000000b
End-Of-Operation with Continuous Conversion
none
none
x0010000b
Retrieve ADC0 Data
ADC0H:ADC0L
none
x0100000b
Retrieve ADC1 Data
ADC1H:ADC1L
none
x0110000b
Retrieve ADC0 and ADC1 Data
ADC0H:ADC0L
ADC1H:ADC1L
x10x0000b
Retrieve Differential Data
ADC0H:ADC0L
(differential result
from both ADCs)
none
x11x0000b
Retrieve Differential and ADC1 Data
ADC0H:ADC0L
(differential result
from both ADCs)
ADC1H:ADC1L
相關PDF資料 |
PDF描述 |
|---|---|
| C8051F317 | 8/16 kB ISP Flash MCU Family |
| C8051F317-GM | 8/16 kB ISP Flash MCU Family |
| C8051F300DK | Mixed Signal ISP Flash MCU Family |
| C8051F300 | Mixed Signal ISP Flash MCU Family |
| C8051F300-GM | Mixed Signal ISP Flash MCU Family |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| C8051F310-GQR | 功能描述:8位微控制器 -MCU 16KB 10ADC 32Pin MCU Tape and Reel RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051F310R | 功能描述:8位微控制器 -MCU 10 ADC 32 Pin RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051F310-TB | 功能描述:插座和適配器 With C8051F310 MCU RoHS:否 制造商:Silicon Labs 產(chǎn)品:Adapter 用于:EM35x |
| C8051F310-TB-K | 功能描述:BOARD PROTOTYPING W/C8051F310 制造商:silicon labs 系列:- 零件狀態(tài):在售 板類型:評估平臺 類型:MCU 8-位 核心處理器:8051 操作系統(tǒng):- 平臺:- 配套使用產(chǎn)品/相關產(chǎn)品:C8051F31x 安裝類型:固定 內(nèi)容:板 標準包裝:1 |
| C8051F311 | 功能描述:8位微控制器 -MCU 16KB 10ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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