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參數(shù)資料
| 型號： | ATF1504ASV-15JU44 |
| 廠商： | Atmel |
| 文件頁數(shù)： | 7/31頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CPLD 15NS LOW VOLT 44PLCC |
| 標準包裝： | 27 |
| 系列： | ATF15xx |
| 可編程類型： | 系統(tǒng)內可編程（最少 10,000 次編程/擦除循環(huán)） |
| 最大延遲時間 tpd(1)： | 15.0ns |
| 電壓電源 - 內部： | 3 V ~ 3.6 V |
| 宏單元數(shù)： | 64 |
| 輸入/輸出數(shù)： | 32 |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 供應商設備封裝： | 44-PLCC |
| 包裝： | 管件 |
| 產品目錄頁面： | 608 (CN2011-ZH PDF) |
| 配用： | ATF15XX-DK3-ND - KIT DEV FOR ATF15XX CPLD'S |
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15
ATF1504ASV(L)
1409J–PLD–6/05
Power-down Mode
The ATF1504ASV(L) includes an optional pin-controlled power-down feature. When this
mode is enabled, the PD pin acts as the power-down pin. When the PD pin is high, the
device supply current is reduced to less than 3 mA. During power down, all output data
and internal logic states are latched internally and held. Therefore, all registered and
combinatorial output data remain valid. Any outputs that were in a High-Z state at the
onset will remain at High-Z. During power down, all input signals except the power-down
pin are blocked. Input and I/O hold latches remain active to ensure that pins do not float
to indeterminate levels, further reducing system power. The power-down mode feature
is enabled in the logic design file or as a fitted or translated s/w option. Designs using
the power-down pin may not use the PD pin as a logic array input. However, all other PD
pin macrocell resources may still be used, including the buried feedback and foldback
product term array inputs.
Notes:
1. For slow slew outputs, add t
SSO.
2. Pin or product term.
3. Includes t
RPA for reduced-power bit enabled.
Power Down AC Characteristics
Symbol
Parameter
-15
-20
Units
Min
Max
Min
Max
t
IVDH
Valid I, I/O before PD High
15
20
ns
tGVDH
Valid OE(2) before PD High
15
20
ns
t
CVDH
Valid Clock(2) before PD High
15
20
ns
t
DHIX
I, I/O Don’t Care after PD High
25
30
ns
tDHGX
OE(2) Don’t Care after PD High
25
30
ns
t
DHCX
Clock(2) Don’t Care after PD High
25
30
ns
t
DLIV
PD Low to Valid I, I/O
1
s
tDLGV
PD Low to Valid OE (Pin or Term)
1
s
t
DLCV
PD Low to Valid Clock (Pin or Term)
1
s
t
DLOV
PD Low to Valid Output
1
s
相關PDF資料 |
PDF描述 |
|---|---|
| GEM22DRTI | CONN EDGECARD 44POS DIP .156 SLD |
| 5-641285-1 | 21 CIR MTA 156 EDG CON F/T LF |
| VE-J43-CW-B1 | CONVERTER MOD DC/DC 24V 100W |
| RSA31DTMT | CONN EDGECARD 62POS R/A .125 SLD |
| EEM10DSEF-S243 | CONN EDGECARD 20POS .156 EYELET |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ATF1504ASV-15QC100 | 功能描述:IC CPLD 64 MACROCELL LV 100PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - CPLD（復雜可編程邏輯器件） 系列:ATF15xx 標準包裝:40 系列:ispMACH® 4000C 可編程類型:系統(tǒng)內可編程 最大延遲時間 tpd(1):5.0ns 電壓電源 - 內部:1.65 V ~ 1.95 V 邏輯元件/邏輯塊數(shù)目:32 宏單元數(shù):512 門數(shù):- 輸入/輸出數(shù):128 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:176-LQFP 供應商設備封裝:176-TQFP（24x24） 包裝:托盤 |
| ATF1504ASV-15QI100 | 功能描述:IC CPLD 15NS LOW VOL 100PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - CPLD（復雜可編程邏輯器件） 系列:ATF15xx 標準包裝:40 系列:ispMACH® 4000C 可編程類型:系統(tǒng)內可編程 最大延遲時間 tpd(1):5.0ns 電壓電源 - 內部:1.65 V ~ 1.95 V 邏輯元件/邏輯塊數(shù)目:32 宏單元數(shù):512 門數(shù):- 輸入/輸出數(shù):128 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:176-LQFP 供應商設備封裝:176-TQFP（24x24） 包裝:托盤 |
| ATF1504ASVL | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Low-voltage, Complex Programmable Logic Device |
| ATF1504ASVL-15JC44 | 功能描述:IC CPLD 64 MACRO 15NS 44PLCC 制造商:microchip technology 系列:ATF15xx 包裝:管件 零件狀態(tài):停產 可編程類型:系統(tǒng)內可編程（最少 10，000 次編程/擦除循環(huán)） 延遲時間 tpd（1）最大值:15.0ns 電源電壓 - 內部:3 V ~ 3.6 V 宏單元數(shù):64 I/O 數(shù):32 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:44-LCC（J 形引線） 供應商器件封裝:44-PLCC（16.59x16.59） 基本零件編號:ATF1504 標準包裝:27 |
| ATF1504ASVL-20 | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Low-voltage, Complex Programmable Logic Device |
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