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參數(shù)資料
| 型號： | ATF1502BE-5AX44 |
| 廠商： | Atmel |
| 文件頁數(shù)： | 7/24頁 |
| 文件大小： | 0K |
| 描述： | IC CPLD 64MC 1.8V 44-TQFP |
| 標(biāo)準(zhǔn)包裝： | 160 |
| 系列： | ATF15xx |
| 可編程類型： | 系統(tǒng)內(nèi)可編程（最少 10,000 次編程/擦除循環(huán)） |
| 最大延遲時間 tpd(1)： | 7.0ns |
| 電壓電源 - 內(nèi)部： | 1.7 V ~ 1.9 V |
| 宏單元數(shù)： | 32 |
| 輸入/輸出數(shù)： | 32 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-TQFP |
| 供應(yīng)商設(shè)備封裝： | 44-TQFP（10x10） |
| 包裝： | 托盤 |
| 配用： | ATF15XX-DK3-ND - KIT DEV FOR ATF15XX CPLD'S |
15
3492A–PLD–12/05
ATF1502BE
11. AC Characteristics
Table 11-1.
AC Characteristics (1)
Symbol
Parameter
-5
-7
Units
Min
Max
Min
Max
tPD1_INP
Switching Delay for Single Input
5.0
5.75
ns
t
PD1
Input or Feedback to Non-registered Output
7
7.5
ns
tPD2
I/O Input or Feedback to Non-registered Feedback
4.5
6
ns
tSU
Global Clock Setup Time
2.5
3.0
ns
t
H
Global Clock Hold Time
0
ns
tFSU
Global Clock Setup Time of Fast Input
1
2
ns
tFH
Global Clock Hold Time of Fast Input
0.5
0.75
ns
t
COP
Global Clock to Output Delay
6
7
ns
tCH
Global Clock High Time
1.25
2.15
ns
tCL
Global Clock Low Time
1.25
2.15
ns
t
ASU
Array Clock Setup Time
1.5
2.0
ns
tAH
Array Clock Hold Time
0.50
ns
tACOP
Array Clock to Output Delay
6
7.5
ns
t
ACH
Array Clock High Time
1.75
2.5
ns
tACL
Array Clock Low Time
1.75
2.5
ns
t
CNT
Minimum Clock Global Period
3
4.75
ns
f
CNT
Maximum Internal Global Clock Frequency
333
210
MHz
tACNT
Minimum Array Clock Period
4
5.5
ns
f
ACNT
Maximum Internal Array Clock Frequency
250
181MHz
t
IN
Input Pad and Buffer Delay
0.5
0.7
ns
tIO
I/O Input Pad and Buffer Delay
0.5
ns
t
FIN
Fast Input Delay
1
ns
t
SEXP
Foldback Term Delay
2
3
ns
tPEXP
Cascade Logic Delay
0.5
1.0
ns
t
LAD
Logic Array Delay
1.2
1.5
ns
t
LAC
Logic Control Delay
1.5
2
ns
tIOE
Internal Output Enable Delay
2
ns
tOD1
Output Buffer and Pad Delay
(High Drive; C
L = 35 pF)
V
CCIO = 1.8V2
2.5
ns
V
CCIO = 3.3V
tZX1
Output Buffer Enable Delay
(High Drive; V
CCIO = 1.8V; CL = 35 pF)
34.0
ns
t
ZX2
Output Buffer Enable Delay
(High Drive; VCCIO = 3.3V; CL = 35 pF)
23
ns
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