參數(shù)資料
型號： AT90S2313-10PC
廠商： Atmel
文件頁數(shù)： 43/92頁
文件大小： 0K
描述： IC MCU 2K FLSH 10MHZ UART 20DIP
標(biāo)準(zhǔn)包裝： 18
系列： AVR® 90S
核心處理器： AVR
芯體尺寸： 8-位
速度： 10MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 15
程序存儲器容量： 2KB（1K x 16）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 128 x 8
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 4 V ~ 6 V
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
48
AT90S2313
0839I–AVR–06/02
UART Baud Rate Register –
UBRR
The UBRR Register is an 8-bit read/write register that specifies the UART Baud Rate
according to the formula on the previous page.
Analog Comparator
The Analog Comparator compares the input values on the positive input AIN0 (PB0) and
the negative input PB1(AIN1). When the voltage on the positive input PB0 (AIN0) is
higher than the voltage on the negative input PB1 (AIN1), the Analog Comparator Out-
put, ACO is set (one). The comparator’s output can be set to trigger the Timer/Counter1
Input Capture function. In addition, the comparator can trigger a separate interrupt
exclusive to the Analog Comparator. The user can select interrupt triggering on compar-
ator output rise, fall or toggle. A block diagram of the comparator and its surrounding
logic is shown in Figure 37.
Figure 37. Analog Comparator Block Diagram
Analog Comparator Control
and Status Register – ACSR
Bit 7 – ACD: Analog Comparator Disable
When this bit is set (one), the power to the Analog Comparator is switched off. This bit
can be set at any time to turn off the Analog Comparator. This will reduce power con-
sumption in active and Idle modes. When changing the ACD bit, the Analog Comparator
Interrupt must be disabled by clearing the ACIE bit in ACSR. Otherwise an interrupt can
occur when the bit is changed.
Bit 6 – Res: Reserved Bit
This bit is a reserved bit in the AT90S2313 and will always read as zero.
Bit
7654
3210
$09 ($29)
MSB
LSB
UBRR
Read/Write
R/W
Initial value
0000
Bit
7654
3210
$08 ($28)
ACD
–
ACO
ACI
ACIE
ACIC
ACIS1
ACIS0
ACSR
Read/Write
R/W
R
R/W
Initial value
00
N/A
0
0000
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PDF描述
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