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參數(shù)資料
| 型號(hào)： | AS7C4098A |
| 廠商： | Alliance Semiconductor Corporation |
| 英文描述： | High Speed CMOS Logic 3-to-8 Line Decoder Demultiplexer with Address Latches 16-PDIP -55 to 125 |
| 中文描述： | 2.5V的為512k × 32/36直通突發(fā)同步SRAM |
| 文件頁數(shù)： | 9/19頁 |
| 文件大?。?/td> | 524K |
| 代理商： | AS7C4098A |
12/23/04, v. 1.2
Alliance Semiconductor
9 of 19
AS7C25512FT32A
AS7C25512FT36A
DC electrical characteristics
LBO and ZZ pins have an internal pull-up or pull-down, and input leakage = ±10
μ
A.
*
V
IH
max < VDD +1.5V for pulse width less than 0.2 X t
CYC
**
V
IL
min = -1.5 for pulse width less than 0.2 X t
CYC
I
DD
operating conditions and maximum limits
Parameter
Sym
Conditions
Min
Max
Unit
Input leakage current
|I
LI
|
V
DD
= Max, 0V < V
IN
< V
DD
OE
≥
V
IH
, V
DD
= Max, 0V < V
OUT
< V
DDQ
-2
2
μA
Output leakage current
|I
LO
|
-2
2
μA
Input high (logic 1) voltage
V
IH
Address and control pins
1.7*
V
DD
+0.3
V
I/O pins
1.7*
V
DDQ
+0.3
V
Input low (logic 0) voltage
V
IL
Address and control pins
-0.3**
0.7
V
I/O pins
-0.3**
0.7
V
Output high voltage
V
OH
I
OH
= –4 mA, V
DDQ
= 2.375V
1.7
–
V
Output low voltage
V
OL
I
OL
= 8 mA, V
DDQ
= 2.625V
–
0.7
V
Parameter
Sym
Conditions
-75
-85
-10
Unit
Operating power supply current
1
1 I
CC
given with no output loading. I
CC
increases with faster cycle times and greater output loading.
I
CC
CE0 < V
IL
, CE1 > V
IH
, CE2 < V
IL
, f = f
Max
,
I
OUT
= 0 mA, ZZ
<
V
IL
All V
IN
≤
0.2V or >
V
DD
– 0.2V,
Deselected,
f = f
Max
, ZZ
<
V
IL
Deselected, f = 0, ZZ
<
0.2V,
all V
IN
≤
0.2V or
≥
V
DD
– 0.2V
Deselected, f = f
Max
, ZZ
≥
V
DD
– 0.2V,
all V
IN
≤
V
IL
or
≥
V
IH
275
250
230
mA
Standby power supply current
I
SB
90
80
80
mA
I
SB1
60
60
60
I
SB2
50
50
50
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PDF描述 |
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