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參數(shù)資料
| 型號(hào)： | AS7C4098A |
| 廠商： | Alliance Semiconductor Corporation |
| 英文描述： | High Speed CMOS Logic 3-to-8 Line Decoder Demultiplexer with Address Latches 16-PDIP -55 to 125 |
| 中文描述： | 2.5V的為512k × 32/36直通突發(fā)同步SRAM |
| 文件頁數(shù)： | 1/19頁 |
| 文件大?。?/td> | 524K |
| 代理商： | AS7C4098A |
December 2004
Copyright Alliance Semiconductor. All rights reserved.
AS7C25512FT32A
AS7C25512FT36A
12/23/04, v. 1.2
Alliance Semiconductor
1 of 19
2.5V 512K
×
32/36 flowthrough burst synchronous SRAM
Features
Organization: 524,288 words × 32 or 36 bits
Fast clock to data access:
7.5/8.5/10.0 ns
Fast OE access time: 3.5/4.0 ns
Fully synchronous flow-through operation
Asynchronous output enable control
Available in 100-pin TQFP package
Individual byte write and global write
Multiple chip enables for easy expansion
2.5V core power supply
Linear or interleaved burst control
Snooze mode for reduced power-standby
Common data inputs and data outputs
Logic block diagram
Selection guide
-75
8.5
7.5
275
90
60
-85
10
8.5
250
80
60
-10
12
10
230
80
60
Units
ns
ns
mA
mA
mA
Minimum cycle time
Maximum clock access time
Maximum operating current
Maximum standby current
Maximum CMOS standby current (DC)
Q0
Q1
19
51Memory
array
Burst logic
CLK
CE
CLR
Address
D
CE
CLK
Q
DQ
CLK
D
Q
registers
DQ
CLK
D
Q
registers
DQ
CLK
D
Q
registers
DQ
CLK
D
Q
registers
Enable
register
D
Q
Enable
rdelay
CLK
D
Q
CLK
buffer
rInput
CLK
Power
down
DQ[a:d]
4
36/32
19
17
19
GWE
BWE
BW
d
ADSC
ADSP
CLK
CE0
CE2
BW
c
BW
b
BW
a
OE
ZZ
LBO
OE
36/32
36/32
A
[18:0]
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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